參數(shù)資料
型號(hào)： MT9071
廠商： Mitel Networks Corporation
英文描述： Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個(gè)獨(dú)立幀調(diào)節(jié)器）)
中文描述： 四T1/E1/J1收發(fā)器（多端口的T1/E1/J1幀調(diào)節(jié)器（集成四個(gè)獨(dú)立幀調(diào)節(jié)器））
文件頁(yè)數(shù)： 95/217頁(yè)
文件大小： 686K
代理商： MT9071
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Preliminary Information
MT9071
95
20.4 T1 Unique Framer Registers Bit Summary - Address Y00- YF7
Tables 51 and 52 describe the bit summary for each of the T1 Unique Framer Registers in the MT9071.
Hex
Address
(A
11
-A
0
)
Y00
R/W
Register
Register Bits (B15-B8 / B7-B0)
Table 78
R/W T1Framing Mode Control
RSV, #, G802, JY, TRANSP, T1DM, ESF, RSV,
CXC, RS1-0, FSI, REFR, MFREFR, JTS, TXSYNC
#, #, #, #, RZCS1-0, TZCS2-1, TZCS0, TPDV,
TXB8ZS, RXB8ZS, ADSEQ, RZNRZ, UNIBI, CLKE
#, #, #, #, #, #, #, #, TESFY, TXSECY, TD4Y, TAIS,
#, TT1DMY, D4SECY, SO
#, #, #, #, #, #, #, #, #, L32Z, BPVE, CRCE, FTE,
FSE, LOSE, PERR
#, #, #, #, #, #, CSIGEN, RBEN, #, RSDB, RFL, #,
SM1-0, SIP1-0
#, #, #, #, #, #, #, #, #, #, DLBK, RSV, SLBK, PLBK,
TLU, TLD
#, #, #, #, HCH4-1, HCH0, HPAYSEL, RSV, RSV,
RSV, BOMEN, HDLCEN, H1R64
#, #, #, #, #, #, #, #, TXBOM7-0
#, #, #, #, #, #, #, #, RXBOMM7-0
Table 80
Y01
R/W T1 Line Coding Control
Table 82
Y02
R/W T1 Transmit Alarm Control
Table 84
Y03
R/W T1 Transmit Error Control
Table 86
Y04
R/W T1 Signaling Control
Table 88
Y05
R/W T1 LoopBack Control
Table 90
Y06
R/W T1 HDLC & DataLink Control
Table 92
Table 94
Y07
Y08
R/W T1 Transmit BOM Data
R/W T1 Receive BOM Match
Control
R/W T1 Receive Idle Code Data
R/W T1 Transmit Idle Code Data
R/W T1 CCS Map Control
R/W T1 Transmit Loop Activate
Code Control
R/W T1 Transmit Loop Deactivate
Code Control
R/W T1 Receive Loop Activate
Code Match Control
Table 51 - T1 Master Control 1 Registers - Address Y00-Y0F
Table96
Table 98
Table 100
Table101
Y09
Y0A
Y0B
Y0D
#, #, #, #, #, #, #, #, RXIDC7-0
#, #, #, #, #, #, #, #, TXIDC7-0
#, #, #, #, #, #, CST4-3, CST2-0, PCM4-0
#, #, #, #, #, #, TXLACL1-0, TXLAC7-0
Table 102
Y0E
#, #, #, #, #, #, TXLDCL1-0, TXLDC7-0
Table 103
Y0F
#, #, #, #, #, #, RXLACL1-0, RXLACM7-0
Hex
Address
(A
11
-A
0
)
YF0
R/W
Register
Register Bits (B15-B8 / B7-B0)
Table 177
R/W T1 Receive Loop Deactivate
Code Match
R/W T1 Interrupt and I/O Control
#, #, #, #, #, #, RXLDCL1-0, RXLDCM7-0
Table 178
YF1
#, #, #, #, #, TX8KE, RXDO, TXMFSEL, SPND,
INTA, DSTOE, CSTOE, RXCO, CNCLR, ACCLR,
RST
#, #, #, #, #, #, #, #, TXSD7-0
Table184
YF7
R/W T1 Transmit Elastic Buffer Set
Delay
Table 52 - T1 Master Control 2 Registers - Address YF0,YF1,YF7
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PDF描述
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MT9072AB 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer
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