- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9071 (Mitel Networks Corporation) Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個(gè)獨(dú)立幀調(diào)節(jié)器）) PDF資料下載
參數(shù)資料
| 型號： | MT9071 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個(gè)獨(dú)立幀調(diào)節(jié)器）) |
| 中文描述： | 四T1/E1/J1收發(fā)器（多端口的T1/E1/J1幀調(diào)節(jié)器（集成四個(gè)獨(dú)立幀調(diào)節(jié)器）） |
| 文件頁數(shù)： | 174/217頁 |
| 文件大?。?/td> | 686K |
| 代理商： | MT9071 |
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MT9071
Preliminary Information
174
Bit
Name
Functional Description
15-4 (#### #### ####) Not Used
3
TA(n)
(#)
2
TB(n)
(#)
1
TC(n)
(#)
0
TD(n)
(#)
Transmit Channel Associated Signaling (CAS) Signaling Bits for Channel 1 to 30.
Address Y51 to Y5F correspond to n=1 to n=15 which correspond to channel 1 to 15 and
the corresponding TA, TB, TC & TD bits are transmitted on the PCM30 link in timeslot 16
in bit positions one to four respectively, in frame n.
Address Y61 to Y6F correspond to n=17 to n=31 which correspond to channel 16 to 30
and the corresponding TA, TB, TC & TD bits are transmitted on the PCM30 link in
timeslot 16 in bit positions five to eight respectively, in frame n-16.
For CAS operation, the signaling bit enable control register bit CSIG (see Table 85 - E1 DL, CCS, CAS and Other Control - R/W
Address Y03) must be set to zero. And, timeslot control must be selected with control register bit MPST(n)=1 in E1 Per Timeslot 0 to
31 Control Registers - R/W Address Y90-YAF.
Refer to Section 10.2 E1 CAS.
Table 163 - E1 Transmit CAS Data Registers - R/W Address Y51-Y5F & Y61-Y6F
Bit
Name
Functional Description
15-4
3
(#### #### ####) Not Used
RA(n)
(#)
Receive Channel Associated Signaling (CAS) Bit A for Channel 1 to 24.
Address Y70 to Y87 correspond to n=1 to n=24 which correspond to channel 1 to 24
and the corresponding RA bit is received from the DS1 link from bit position 8 of the
6th DS1 frame (within the 12 frame superframe structure for D4 superframes and the
24 frame structure for ESF superframes).
Receive Channel Associated Signaling (CAS) Bit B for Channel 1 to 24.
Address Y70 to Y87 correspond to n=1 to n=24 which correspond to channel 1 to 24
and the corresponding RB bit is received from the DS1 link from bit position 8 of the
12th DS1 frame (within the 12 frame superframe structure for D4 superframes and the
24 frame structure for ESF superframes).
Receive Channel Associated Signaling (CAS) Bit C for Channel 1 to 24.
Address Y70 to Y87 correspond to n=1 to n=24 which correspond to channel 1 to 24
and the corresponding RC bit is received from the DS1 link from bit position 8 of the
18th DS1 frame within the 24 frame structure for ESF superframes. These bits are not
used in D4 mode.
Receive Channel Associated Signaling (CAS) Bit D for Channel 1 to 24.
Address Y70 to Y87 correspond to n=1 to n=24 which correspond to channel 1 to 24
and the corresponding RD bit is received from the DS1 link from bit position 8 of the
24th DS1 frame within the 24 frame structure for ESF superframes. These bits are not
used in D4 mode.
2
RB(n)
(#)
1
RC(n)
(#)
0
RD(n)
(#)
For CAS operation, the robbed bit enable control register bit RBEN (see Table 86 - T1 Signaling Control - R/W Address Y04) must be
set to one. In addition, CAS operation must be enabled on a per channel basis by setting the clear channel per timelsot control
register bit CC (see Table 166 - T1 Per Channel 1 to 24 Control Registers - R/W Address Y90-YA7) to zero.
Refer to 10.1 T1 CAS.
Table 164 - T1 Receive CAS Data Registers - R Address Y70-Y87
Bit
Name
Functional Description
15-4 (#### #### ####) Not Used
Table 165 - E1 Receive CAS Data Registers - R Address Y71-Y7F, Y81-Y8F
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