- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9071 (Mitel Networks Corporation) Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個獨立幀調(diào)節(jié)器）) PDF資料下載
參數(shù)資料
| 型號： | MT9071 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個獨立幀調(diào)節(jié)器）) |
| 中文描述： | 四T1/E1/J1收發(fā)器（多端口的T1/E1/J1幀調(diào)節(jié)器（集成四個獨立幀調(diào)節(jié)器）） |
| 文件頁數(shù)： | 56/217頁 |
| 文件大小： | 686K |
| 代理商： | MT9071 |
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MT9071
Preliminary Information
56
A dedicated multiframe boundary pin is included which provides the user the option of setting the multiframe
boundaries with an external device. Refer to the TxMF pin description and to the CRC-4 and CAS sections for
details.
7.6
Reset Operation (RESET, TRST Pins)
On initial power up, a hard reset must be done using both the RESET pin and the TRST pin. A valid reset
condition requires both of these inputs to be held low for a minimum of 100ns. These inputs should be set to
zero during initial power up, then set to one.
After initial power up, the MT9071 can be reset using the hardware pin RESET, or the control register bit RSTC
(see Table 70 - T1 & E1 Global Mode Control - R/W Address 900). In addition, individual transceivers within the
MT9071 may be reset with the control register bit RST (see Table 178 - T1 Interrupt and I/O Control - R/W
Address YF1 and Table 85 - E1 DL, CCS, CAS and Other Control - R/W Address Y03). Note that the common
control (global) registers can only be reset with RESET pin or the RSTC bit. When the device emerges from its
reset state it will begin to function with default settings (see Table 13 - Reset Default Status). A reset operation
takes 1 full frame (125 us) to complete.
7.7
Control Pins
7.7.1
Transmit AIS Operation (TAIS Pin)
The TAIS pin allows all four transceivers of the MT9071 to transmit an all ones signal (AIS) at the TTIP and
TRNG output pins from the point of power-up, without the need to write to any control registers. During this
time the IRQ pin is in a high impedance state. After the interface has been initialized normal operation can take
place by making TAIS high.
7.7.2
IEEE 1149.1-1990 Test Access Port (TAP)
Five signals (TDI, TDO, TMS, TCK & TRST) make up the Test Access Port (TAP) of the IEEE 1149.1-1990
Standard Test Port and Boundary-Scan Architecture. The TAP provides access to test support functions built
into the MT9071. The TAP is also referred to as a JTAG (Joint Test Action Group) port, see Section 8.0 JTAG
Operation.
Function
Status
Mode T1 or E1
System Bus (Backplane)
Counters
Counter Latches
Interrupts
Per Timeslot Control Buffer
Loopbacks
Error Insertion
CAS ABCD Bit Debounce
HDLC
T1
2.048Mb/s
cleared
cleared
all unmasked but suspended and cleared
All locations cleared
deactivated
deactivated
deactivated
deactivated
Table 13 - Reset Default Status
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90820 | Large Digital Switch(大數(shù)字開關(guān)) |
| MT90823 | 3V Large Digital Switch(3V 大數(shù)字開關(guān)) |
| MT90826 | Quad Digital Switch(四數(shù)字開關(guān)) |
| MT90840 | Distributed Hyperchannel Switch(分布式超級通道開關(guān)) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90710 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:High-Speed Isochronous Multiplexer |
| MT90710AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:High-Speed Isochronous Multiplexer |
| MT9072 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AB | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
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