- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄384760 > MT9071 (Mitel Networks Corporation) Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個獨(dú)立幀調(diào)節(jié)器）) PDF資料下載
參數(shù)資料
| 型號： | MT9071 |
| 廠商： | Mitel Networks Corporation |
| 英文描述： | Quad T1/E1/J1 Transceiver(多端口 T1/E1/J1幀調(diào)節(jié)器（集成四個獨(dú)立幀調(diào)節(jié)器）) |
| 中文描述： | 四T1/E1/J1收發(fā)器（多端口的T1/E1/J1幀調(diào)節(jié)器（集成四個獨(dú)立幀調(diào)節(jié)器）） |
| 文件頁數(shù)： | 182/217頁 |
| 文件大?。?/td> | 686K |
| 代理商： | MT9071 |
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MT9071
Preliminary Information
182
Bit
Name
Functional Description
15
14
13
12
11
10
9
8
EHT7
EHT6
EHT5
EHT4
EHT3
EHT2
EHT1
EHT0
(0000 0000)
ELT7
ELT6
ELT5
ELT4
ELT3
ELT2
ELT1
ELT0
(0000 0000)
Table 176 - T1 & E1 LIU Receive Equalizer Threshold Control - R/W Address YE6
Receive Equalizer High Threshold.
These bits set the highest possible binary count
tolerable coming out of the equalized signal peak detector before a lower level of equalization
is selected. This register is only used when A/D based automatic equalization is selected (see
Table 173 - T1 & E1 LIU Control - R/W Address YE3).
7
6
5
4
3
2
1
0
Receiver Equalization Low Threshold.
These bits set the lowest possible binary count
tolerable coming out of the equalized signal peak detector before a higher level of equalization
is selected. This register is only used when A/D based automatic equalization is selected (see
Table 173 - T1 & E1 LIU Control - R/W Address YE3).
Bit
Name
Functional Description
15-
10
9
8
(#### ##)
Not Used
RXLDCL1
RXLDCL0
(01)
Receive Loop Deactivate Code Length.
Setting these bits determines the length of the
transmit loop down code as detailed in the table below:
RXLDCL1
RXLDCL0
Receive Loop Deactivate Code Length
0
0
Code length is 5 bits.
0
1
Code length is 6 or 3 bits.
1
0
Code length is 7 bits.
1
1
Code length is 8 or 4 bits.
Receive Loop Deactivate Code Match.
This byte specifies the match code for the receive
loopback deactivate code. The contents of this register are compared to the received data,
and an a maskable interrupt LLDDI (see Table 151 - T1 Receive Line and Timer Interrupt
Status - R Address Y35) is generated if the contents match.
7
6
5
4
3
2
1
0
RXLDCM7
RXLDCM6
RXLDCM5
RXLDCM4
RXLDCM3
RXLDCM2
RXLDCM1
RXLDCM0
(0000 1001)
Table 177 - T1 Receive Loop Deactivate Code Match - R/W Address YF0
Bit
Name
Functional Description
15-8
(####
####)
TX8KE
(0)
Not Used
10
Transmit 8 KHz Enable.
This is normally set to zero but may be used in conjunction with the
auxiliary signals, see Section 3.6 Auxiliary Output SIgnals. If one, the pin RxMF (AUX pin, see
Section 3.6 Auxiliary Output SIgnals) transmits a positive 8 KHz frame pulse synchronous with
the serial data stream transmit on TTIP/TRNG. If zero, the pin RxMF transmits a negative
frame pulse synchronous with the multiframe boundary of data coming out of DSTo.
Table 178 - T1 Interrupt and I/O Control - R/W Address YF1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT9072 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90820 | Large Digital Switch(大數(shù)字開關(guān)) |
| MT90823 | 3V Large Digital Switch(3V 大數(shù)字開關(guān)) |
| MT90826 | Quad Digital Switch(四數(shù)字開關(guān)) |
| MT90840 | Distributed Hyperchannel Switch(分布式超級通道開關(guān)) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT90710 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:High-Speed Isochronous Multiplexer |
| MT90710AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:High-Speed Isochronous Multiplexer |
| MT9072 | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AB | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
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