參數(shù)資料
型號： MPC105
廠商： MOTOROLA INC
元件分類： 存儲控制器/管理單元
英文描述： 32-Bit Microprocessor(32位微處理器)
中文描述： 1G X 8, DRAM CONTROLLER, PBGA304
封裝： BGA-304
文件頁數(shù)： 310/311頁
文件大?。?/td> 1708K
代理商： MPC105
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Index-8
MPC105 PCIB/MC User's Manual
MOTOROLA
INDEX
Timing diagrams
60x single-beat/burst data transfers, 4-20
acronyms in DRAM timing diagrams, 6-10
CBR refresh timing, DRAM, 6-19
CBR refresh timing, SDRAM, 6-32
CF_DOE timing, L2 interface, 5-19
CF_L2_HIT_DELAY timing, L2 interface, 5-18
CF_WDATA timing, L2 interface, 5-19
CF_WMODE timing, L2 interface, 5-20
DRAM burst-of-four read, 6-13, 6-14
DRAM burst-of-four write, 6-16
DRAM RTC refresh in suspend mode, 6-22
DRAM single-beat read, 6-12
DRAM single-beat write, 6-15
Flash memory write, 6-41
Flash ROM burst read, 6-40
Flash ROM half-word read, 6-39
Flash ROM single-byte read, 6-39
legend for L2 interface timing, 5-24
PCI read operation, 7-10
PCI write operation, 7-10
ROM burst read timing, 6-37
ROM nonburst read timing, 6-36
SDRAM burst-of-four read, 6-29
SDRAM burst-of-four write, 6-30
SDRAM mode-set command timing, 6-30
SDRAM self-refresh entry, 6-33
SDRAM self-refresh exit, 6-34
SDRAM single-beat read, 6-28
SDRAM single-beat write, 6-29
self-refresh in sleep and suspend modes, 6-21
TMS (JTAG test mode select) signal, 2-32, C-2
TOE/DBG1 signal, 1-5, 2-16, 2-17
Transactions, 7-12
Transactions, PCI bus
PCI bus transactions, 7-9
termination, 7-11
Transfer
60x address tenure, 4-5
60x data tenure, 4-5
aligned data transfer, 60x, 4-13, 4-15
TRDY (target ready) signal, 2-24, 7-4, 7-11
TRST (JTAG test reset) signal, 2-32, C-2
TS signal, 2-4
TSIZ0–TSIZ2 signals, 2-6, 4-12
TT0–TT4 signals, 2-5, 4-9
TV (tag valid) signal, 2-15, 5-4
TWE signal, 2-15, 5-17
W
WE signal, 2-19, 6-27
Write-back
L2 cache response, 5-6
support for L2 cache operation, 1-4, 5-1
write-back cache with 105, 5-1
Write-through
L2 cache response, 5-13
support for L2 cache operation, 1-4, 5-1
write-through cache with 105, 5-2
Write-with-autoprecharge command, SDRAM, 6-26
WT signal, 2-10, 5-6
X
XATS signal
as a configuration input, 2-33
description, 2-4
selection of memory maps, 3-1, 3-43
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PDF描述
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