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參數(shù)資料
| 型號(hào)： | MPC105 |
| 廠商： | MOTOROLA INC |
| 元件分類(lèi)： | 存儲(chǔ)控制器/管理單元 |
| 英文描述： | 32-Bit Microprocessor(32位微處理器) |
| 中文描述： | 1G X 8, DRAM CONTROLLER, PBGA304 |
| 封裝： | BGA-304 |
| 文件頁(yè)數(shù)： | 11/311頁(yè) |
| 文件大?。?/td> | 1708K |
| 代理商： | MPC105 |
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MOTOROLA
Illustrations
xiii
ILLUSTRATIONS
Figure
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3-33
System Implementation and Block Diagram ......................................................1-2
MPC105 Signal Groupings .................................................................................2-2
SYSCLK Input with Internal Multiples............................................................2-34
Address Map A (Contiguous Map).....................................................................3-3
Address Map A (Discontiguous Map) ................................................................3-4
PCI I/O Map (Address Map A)...........................................................................3-5
PCI Memory Map (Map A).................................................................................3-6
Address Map B....................................................................................................3-8
MPC105 Configuration Registers.....................................................................3-14
PCI Command Register.....................................................................................3-16
PCI Status Register............................................................................................3-18
Power Management Configuration Register (PMCR)......................................3-19
Error Enabling Register 1 (ErrEnR1)................................................................3-21
Error Enabling Register 2 (ErrEnR2)................................................................3-23
Error Detection Register 1 (ErrDR1)—0xC1....................................................3-24
Error Detection register 2 (ErrDR2)—0xC5.....................................................3-25
60x Bus Error Status Register—0xC3 ..............................................................3-26
PCI Bus Error Status Register—0xC7..............................................................3-26
60x/PCI Error Address Register—0xC8...........................................................3-27
Memory Starting Address Register 1—0x80....................................................3-28
Memory Starting Address Register 2—0x84....................................................3-28
Extended Memory Starting Address Register 1—0x88....................................3-28
Extended Memory Starting Address Register 2—0x8C...................................3-29
Memory Ending Address Register 1—0x90.....................................................3-30
Memory Ending Address Register 2—0x94.....................................................3-30
Bit Settings for Extended Memory Ending Address Register 1........................3-30
Extended Memory Ending Address Register 2—0x9C ....................................3-31
Memory Bank Enable Register—0xA0 ............................................................3-32
Memory Control Configuration Register 1 (MCCR1)—0xF0..........................3-33
Memory Control Configuration Register 2 (MCCR2) (RAM Access Time) ...3-36
Memory Control Configuration Register 3 (MCCR3)......................................3-37
Memory Control Configuration Register 4 (MCCR4)......................................3-39
Processor Interface Configuration Register 1 ...................................................3-42
Processor Interface Configuration Register 2 ...................................................3-46
Alternate OS-Visible Parameters Register 1.....................................................3-50
Alternate OS-Visible Parameter Register 2 ......................................................3-51
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