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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 521/609頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應商設備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
553
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
STEP 5 - Enable the Receive LAPD Interrupt (Optional).
This step is optional.
However, if this step is executed, the XRT79L71 will generate an interrupt to the
Microprocessor anytime the Receive LAPD Controller block has completed its reception of a new PMDL
Message. The purpose of this interrupt is to notify the Microprocessor that the Receive LAPD Message buffer
contains a newly received LAPD/PMDL Message that needs to be read.
The procedure for enabling the Receive LAPD Interrupt is actually a three-step process.
STEP 5a - Enable the DS3/E3 Framer block interrupts - At the Operational Block Level.
This step is accomplished by setting Bit 2 (DS3/E3 Framer Block Interrupt Enable) to "1" as illustrated below.
This step enables the DS3/E3 Framer block for interrupt generation at the Operational Block Level.
STEP 5b - Enable the Receive DS3/E3 Framer block Interrupts - At the Block Level.
This step is accomplished by setting Bit 7 (Receive DS3/E3 Framer Block Interrupt Enable), within the Block
Interrupt Enable Register, to "1", as illustrated below.
This step enables the Receive DS3/E3 Framer block for interrupt generation, at the Block Level.
STEP 5c - Enable the Receive LAPD Interrupt at the Source Level.
Receive E3 LAPD Status Register (Address = 0x1119)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
RxABORT
RxLAPDType[1:0]
RxCR Type
RxFCS Error
End of
Message
Flag Present
R/O
0
1
Operation Block Interrupt Enable Register - Byte 1 (Address = 0x0116)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
DS3/E3 LIU/
JA Block
Interrupt
Enable
DS3/E3
Framer
Block Inter-
rupt Enable
Unused
R/O
R/W
R/O
0
1
0
Framer Block Interrupt Enable Register (Address = 0x1104)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Receive
DS3/E3
Framer
Block Inter-
rupt Enable
Receive
PLCP
Processor-
Block
Interrupt
Enable
Unused
Transmit
DS3/E3
Framer
Block Inter-
rupt Enable
One Second
Interrupt
Enable
R/W
R/O
R/W
1
0
X
相關PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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