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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 307/609頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應商設備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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PRELIMINARY
XRT79L71
360
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
It will generate the "Change of LOL (Loss of Lock) Defect Condition" Interrupt. The XRT79L71 will indicate
that it is generating this interrupt by (a) asserting the Interrupt Request output pin (by toggling it "LOW"), and
(b) by setting Bit 2 (Change of LOL Condition Interrupt), within the "LIU Interrupt Status" Register, to "1" as
depicted below.
For the duration that the Clock and Data Recovery block is declaring the "LOL Defect Condition" then all of the
following will be true.
The Clock and Data Recovery block will be synthesizing a 34.368MHz clock signal that is derived from the
"Reference" Clock signal (which originates from the "SFM Synthesizer" block).
The Clock and Data Recovery block will route this 34.368MHz clock signal to all down-stream circuitry (e.g.,
the Receive DS3/E3 Framer block, etc.). Each of these down-stream blocks will use this 34.368MHz clock
signal as their timing source.
The Clock and Data Recovery Block and its "LOL Defect Declaration" Behavior during "Signal Present"
and "No Signal Present" Conditions
Once the Clock and Data Recovery Block has declared the "LOL Defect Condition", then any subsequent
behaviour of the Clock and Data Recovery Block, depends upon whether the AGC Block (within the Receive
DS3/E3 LIU Block) determines that some sort of signal energy is present (at the RTIP/RRING input pins) or
not.
If "No Signal is present" at the RTIP/RRING Input Pins
If the incoming E3 line signal were to be removed, such that there is absolutely no signal energy being applied
to the RTIP/RRING input pins, then all of the following will happen.
The Receive DS3/E3 LIU Block will declare the LOS Defect Condition (please see SEE”THE LOS
information on how the Receive DS3/E3 LIU Block declares the LOS Defect Condition).
LIU Alarm Status Register (Address = 0x1303)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Digital
LOS
Defect
Declared
Analog
LOS
Defect
Declared
FL
(FIFO Limit)
Alarm
Declared
Receive
LOL
Defect
Declared
Receive
LOS Defect
Declared -
Receive
DS3/E3 LIU
Block
Transmit
DMO
Condition
R/O
0
1
0
LIU Interrupt Status Register (Address = 0x1302)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Change of
FL
Condition
Interrupt
Status
Change of
LOL
Condition
Interrupt
Status
Change of
LOS
Condition
Interrupt
Status
Change of
DMO
Condition
Interrupt
Status
R/O
RUR
0
1
0
相關PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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