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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 145/609頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應(yīng)商設(shè)備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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PRELIMINARY
XRT79L71
214
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
Clearing the AIS Defect Condition
The Receive DS3 Framer block will clear the AIS defect condition when the following expression is true.
NAIS - NVALID
0.
In other words, once the Receive DS3 Framer block has detected a sufficient number of normal or Non-AIS M-
frames, such that this Up/Down counter reaches zero, then the Receive DS3 Framer block will clear the AIS
Defect Condition.
The Receive DS3 Framer block will indicate that it is clearing the AIS defect by:
Setting Bit 7 (AIS Defect Declared) within the Receive DS3 Configuration and Status Register to "0", as
depicted below.
The Receive DS3 Framer block will also generate the Change in AIS Defect Condition interrupt, by asserting
the Interrupt Output pin (e.g., by pulling it "Low") and setting Bit 5 (Change of AIS Defect Condition Interrupt
Status), within the Receive DS3 Interrupt Status Register to "1" as illustrated below.
4.3.2.5
DECLARING AND CLEARING THE DS3 IDLE PATTERN
The Receive DS3/E3 Framer block has the responsibility for declaring and clearing the DS3 Idle condition
indicator, as described below.
4.3.2.5.1
Declaring the Idle Condition
The Receive DS3 Framer block will identify and declare an Idle Condition if it receives a sufficient number of
M-Frames within the DS3 data stream that meets all of the following conditions.
Valid M-bits, F-bits, and P-bits
The 3 CP-bits (in F-Frame #3) are zeros.
The X-bits are set to "1"
The payload portion of the DS3 Frame exhibits a repeating "1100..." pattern.
The Receive DS3 Framer block contains, within its circuitry, an Up/Down Counter that supports the assertion
and clearance of the Idle Condition. The counter begins with the value of 0x00 upon power up or reset. The
counter is incremented anytime the Receive DS3 Framer block detects an Idle-type M-frame. The counter is
Receive DS3 Configuration and Status Register (Address = 0x1110)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
AISDefect
Declared
LOS Defect
Declared
Idle Condi-
tion Detected
OOF Defect
Declared
Unused
Framing with
Valid P-Bits
F-SyncAlgo
M-SyncAlgo
R/O
R/W
0
Receive DS3 Interrupt Status Register (Address = 0x1113)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Detection of
CP Bit Error
Interrupt
Status
Change of
LOS Defect
Condition
Interrupt
Status
Change of
AIS Defect
Condition
Interrupt
Status
Change of
Idle Condi-
tion Inter-
rupt
Status
Change of
FERF Defect
Condition
Interrupt
Status
Change of
AIC State
Interrupt
Status
Change of
OOF Defect
Condition
Interrupt
Status
Detection of
P-Bit Error
Interrupt
Status
RUR
0
1
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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