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參數(shù)資料
型號(hào)： XRT79L71IB-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 11/609頁(yè)
文件大?。?/td> 0K
描述： IC LIU/FRAMER DS3/E3 1CH 208BGA
標(biāo)準(zhǔn)包裝： 126
控制器類型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LBGA
供應(yīng)商設(shè)備封裝： 208-STBGA（17x17）
包裝： 托盤
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XRT79L71
PRELIMINARY
93
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
TABLE 15: HOW THE TRANSMIT DS3 FRAMER BLOCK INTERNALLY GENERATES EACH OF THE OVERHEAD BITS - C-
BIT PARITY APPLICATIONS
BIT NAME
BIT DESCRIPTION
HOW THE OVERHEAD BIT IS INTERNALLY GENERATED BY THE TRANSMIT
DS3 FRAMER BLOCK
X-Bits (2)
FERF/Yellow Alarm Indicator
Bits
Either Software Controlled or automatically set to "0" whenever the cor-
responding Receive DS3 Framer block declares the LOS, LOF/OOF or
AIS defect condition.
F1 Bits (14)
F-Frame Framing Alignment
bits that are of the value "1"
Set to the value of "1".
F0 Bits (14)
F-Frame Framing Alignment
bits that are of the value "0".
Set to the value of "0".
M1 Bit (1)
M-Frame Framing Alignment
bits that are of the value "1
Set to the value of "1".
M0 Bits (2)
M-Frame Framing Alignment
bits that are of the value "0"
Set to the value of "0".
P-bits (2)
Parity Bits
Transmit DS3 Framer block computes the even parity value over the
payload bits within a given DS3 frame. The results of this calculation are
inserted into the two P-bit positions within the very next DS3 frame.
CP-bits (3)
Path Parity Bits
Transmit DS3 Framer block computes the even parity value over the
payload bits within a given DS3 frame. The results of this calculation are
inserted into the three CP-bit positions within the very next DS3 frame.
AIC bit (1)
Application Identical Channel
Set to the value "1" in order to denote C-bit Parity framing format.
UDL bits (9)
User Data Link Bits
Set to the value "1".
DL bits (3)
Path Maintenance Data Link
(PMDL) bits
These bits carry the PMDL/LAPD Message that is generated by the
LAPD Transmitter within the Transmit Section of the XRT79L71.
However, if the Transmit LAPD Controller block is not being used, then
these bits will each be set to "1".
FEAC bit (1)
Far-End Alarm & Control Bit
This bit carries the FEAC Message that is generated by the Transmit
FEAC Processor within the Transmit Section of the XRT79L71.
However, if the Transmit FEAC Controller Block is not being used, then
this bit will be set to "1"
FEBE bits (3)
Far-End Block Error Bits
These bits are set to [1, 1, 1] whenever the corresponding Receive DS3
Framer block detects no CP nor framing F and M bit errors within its
incoming DS3 data-stream. These bits are set to values other than [1, 1,
1] whenever the corresponding Receive DS3 Framer block detects CP
or framing bit errors within its incoming DS3 data-stream.
NOTE: These bit-fields can also be software-controlled.
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PDF描述
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