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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 347/609頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應(yīng)商設(shè)備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
395
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
Frame Check Sequence Bytes
The 16 bit FCS (Frame Check Sequence) is calculated over the LAPD Message Header and Information
Payload bytes, by using the CRC-16 polynomial, x16 + x12 + x5 + 1. Afterwards, this FCS value is inserted
into the two-octet "FCS value" position, within the LAPD Message frame. The Receive LAPD Controller block
will use the FCS bytes in order to verify that it has received a given LAPD Message in an un-erred manner.
Please see SEE”TRANSMIT LAPD CONTROLLER BLOCK” ON PAGE 303. on how the Transmit LAPD
Controller block computes and inserts the FCS values into its "outbound" LAPD Message frames.
Operation of the Receive LAPD Controller
As mentioned earlier, the Receive LAPD Controller permits the user to receive either of the following basic
types of LAPD Messages.
Standard (e.g., 76 or 82 byte size) LAPD Messages
Variable Length (e.g., up to 82 byte size) LAPD Messages
The procedure for receiving these types of LAPD Messages is presented below.
5.3.3.1
Receiving Standard-type (76 or 82 byte size) LAPD Messages
The user can (1) configure the Receive LAPD Controller block to extract out the contents of the incoming
PMDL Messages from the incoming E3 data-stream, and (2) to properly read out the contents of a newly
received message (which is being stored in the "Receive LAPD Message" buffer), by executing the following
steps.
STEP 1 - Make sure that the XRT79L71 has been configured to operate in the "E3, ITU-T G.751" Framing
format.
This is accomplished by reading out the contents of the Framer Operating Mode Register (Address = 0x1100)
and verifying that Bit 6 (DS3/E3*) is set to "0" and that Bit 2 (Frame Format) is set to "0"; as illustrated below.
STEP 2 - Enable the Receive LAPD Controller Block
This is accomplished by setting Bit 2 (Receive LAPD Enable) within the Receive E3 LAPD Control Register" to
"1" as depicted below.
NOTES:
Framer Operating Mode Register (Address = 0x1100)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Local
Loop-back
DS3/E3*
InternalLOS
Enable
RESET
Direct
Mapped ATM
Frame
Format
Timing Reference Select
[1:0]
R/W
X
0
X
0
X
0
X
Receive E3 LAPD Control Register - G.751 (Address = 0x1118)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
RxLAPD
Any
Unused
Receive
LAPD
Enable
Receive
LAPD
Interrupt
Enable
Receive
LAPD
Interrupt
Status
R/W
R/O
R/W
RUR
0
1
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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