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參數(shù)資料
型號(hào)： XRT79L71IB-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 34/609頁(yè)
文件大小： 0K
描述： IC LIU/FRAMER DS3/E3 1CH 208BGA
標(biāo)準(zhǔn)包裝： 126
控制器類型： DS3/E3 調(diào)幀器
接口： LIU
電源電壓： 3.15 V ~ 3.45 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LBGA
供應(yīng)商設(shè)備封裝： 208-STBGA（17x17）
包裝： 托盤
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PRELIMINARY
XRT79L71
114
REV. P2.0.0
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
NOTE: The six-bit code word must be written in Bits 1 through 6 within this register. Bits 0 and 7 are in-active bits and are
each forced to "0".
STEP 2- Enable the Transmit FEAC Controller Block
In order to enable the Transmit FEAC Controller Block the user must write a "1" into bit 2 (TxFEAC Enable)
within the Transmit DS3 FEAC Configuration and Status Register, as depicted below.
At this point, the Transmit FEAC Controller Block will be turned on and will begin to repeatedly transmit the Idle
FEAC pattern of [1, 1, 1, 1, 1, 1].
STEP 3 - Enable the Transmit FEAC Message Interrupt (Optional)
This step is optional. However, if this step is executed, then the XRT79L71 will generate an interrupt to the
Microprocessor, as soon as the Transmit FEAC Controller block has completed its 10th transmission of the
FEAC Message. The purpose of this interrupt is to alert the system Microprocessor that the Transmit FEAC
Controller block has completed its 10th transmission of the most recent outbound FEAC Message, and that it
is now available to transmit a different FEAC Message.
The procedure for enabling the Transmit FEAC Interrupt is actually a three-step process.
STEP 3a - Enable the DS3/E3 Framer block interrupt as the Operational Block Level
This step is accomplished by setting Bit 2 (DS3/E3 Framer Block Interrupt Enable) to "1" as illustrated below.
STEP 3b - Enable the Transmit DS3/E3 Framer Block Interrupts - at the Block Level
This step is accomplished by setting Bit 1 (Transmit DS3/E3 Framer Block Interrupt Enable), within the Block
Interrupt Enable Register to "1" as depicted below.
Transmit DS3 FEAC Register (Address = 0x1132)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Not Used
TxFEAC_Code_Word[5:0]
Not Used
R/O
R/W
R/O
0
d5
d4
d3
d2
d1
d0
0
Transmit DS3 FEAC Configuration and Status Register (Address = 0x1131)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Not Used
Tx FEAC
Interrupt
Enable
Tx FEAC
Interrupt
Status
Tx FEAC
Enable
Tx FEAC Go
Tx FEAC
Busy
R/O
R/W
R/O
R/W
R/O
0
X
1
0
Operation Block Interrupt Enable Register - Byte 1 (Address = 0x0116)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
DS3/E3 LIU/JA
Block Interrupt
Enable
DS3/E3 Framer
Block Interrupt
Enable
Unused
R/W
R/O
R/W
R/O
0
1
0
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PDF描述
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參數(shù)描述
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