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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 110/609頁 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標準包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應商設備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
183
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
NOTE: By default, the Receive Equalizer block will (upon power up) be disabled. Therefore, the user MUST include
enabling the Receive Equalizer block as a part of the start-up/configuration procedure.
4.3.1.4
The Clock and Data Recovery Block
The purpose of the Clock and Data Recovery block (within the Receive DS3/E3 LIU Block) is two-fold.
To acquire and maintain phase-lock with the incoming DS3 or E3 line signal.
To insure that downstream circuitry, (such as the Receive DS3/E3 Framer block) is always provided with a
line-rate clock signal (to use as it timing reference).
Upon power-up, the Clock and Data Recovery block will attempt to acquire phase-lock with the incoming DS3
or E3 line signal. Once the Clock and Data Recovery block has acquired lock with the incoming DS3 or E3
signal, then it will indicate this fact by doing all of the following.
It will set Bit 2 (Receive LOL Defect Declared), within the LIU Alarm StatusRegister, to "0" as depicted below.
It will generate the Change of LOL (Loss of Lock) Defect Condition Interrupt. The XRT79L71 will indicate
that it is generating this interrupt by (a) asserting the Interrupt Request output pin (by toggling it "Low"), and
(b) by setting Bit 2 (Change of LOL Condition Interrupt), within the LIU Interrupt Status Register, to "1" as
depicted below.
LIU Receive Control Register (Address = 0x1305)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Disable
DLOS
Detector
Disable
ALOS Detec-
tor
Unused
LOSMUT
Enable
Receive
Monitor
Mode Enable
Receive
Equalizer
Enable
R/O
R/W
R/O
R/W
0
1
LIU Alarm Status Register (Address = 0x1303)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Digital LOS
Defect
Declared
Analog LOS
Defect
Declared
FL (FIFO
Limit) Alarm
Declared
Receive LOL
Defect
Declared
Receive LOS
Defect
Declared -
Receive
DS3/E3 LIU
Block
Transmit
DMO Condi-
tion
R/O
0
相關PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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