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參數(shù)資料
| 型號： | XRT79L71IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 157/609頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 標(biāo)準(zhǔn)包裝： | 126 |
| 控制器類型： | DS3/E3 調(diào)幀器 |
| 接口： | LIU |
| 電源電壓： | 3.15 V ~ 3.45 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 208-LBGA |
| 供應(yīng)商設(shè)備封裝： | 208-STBGA（17x17） |
| 包裝： | 托盤 |
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XRT79L71
PRELIMINARY
9
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
1.1.11
The Receive SSM Controller Block (E3, ITU-T G.832 Applications Only)
The purpose of the Receive SSM Controller Block is to permit a given terminal equipment to receive (and
extract out) the SSM (Synchronization Status Message) from the remote terminal equipment, via the MA byte,
within each inbound E3, ITU-T G.832 frame.
1.1.12
The Receive Trail-Trace Message Controller Block (E3, ITU-T G.832 Applications Only)
The purpose of the Receive Trail-Trace Message Controller block is to permit a given terminal equipment to
receive (and extract out) the Trail-Trace Message from the remote terminal equipment, via the TR byte, within
each inbound E3, ITU-T G.832 frame.
1.1.13
The Receive FEAC Controller Block (DS3 Applications Only)
The purpose of the Receive FEAC Controller block is to permit the user to receive FEAC (Far-End Alarm &
Control) Messages from the remote terminal equipment.
NOTE: The Receive FEAC Controller Block is only active if the XRT79L71 is configured to operate in the DS3, C-bit Parity
Framing format.
1.1.14
The Receive LAPD Controller Block
The purpose of the Receive LAPD Controller block is to permit the user to receive LAPD/PMDL (Path
Maintenance Data Link) Messages from the remote terminal equipment. The Receive LAPD Controller block
comes with a Receive LAPD Controller and 90 bytes of on-chip RAM (for storage of inbound PMDL Messages)
after reception.
1.1.15
The Receive Payload Data Output Interface Block
The purpose of the Receive Payload Data Output Interface block is to output payload data (within the incoming
DS3 or E3 data-stream) via either a Serial or Nibble-Parallel interface, and to route this data to the off-chip
System-Side Terminal Equipment.
1.1.16
The Receive Overhead Data Output Interface Block
The purpose of the Receive Overhead Data Output Interface block is to permit the user to extract out the
overhead bits (within the incoming DS3/E3 data-stream) and to route this data to some off-chip System-Side
Terminal Equipment circuitry.
1.1.17
A more detailed Functional/Architectural Description of the XRT79L71 when configured to
operate
in
the
Clear
Channel
Controller
Mode,
is
in
this
document
(79L71_Arch_Descr_CC.pdf).
(Section 7.0- Architectural/Functional Description of the XRT79L71 1-Channel DS3/E3 ATM UNI/PPP/Clear-
Channel Framer with LIU IC - Clear Channel Applications).
1.2
BRIEF FUNCTIONAL ARCHITECTURE DESCRIPTION OF THE XRT79L71 - HIGH-SPEED HDLC
CONTROLLER OVER DS3/E3 MODE
If the XRT79L71 has been configured to operate in the High-Speed HDLC Controller over DS3/E3 Mode, then
it will have the Functional Architecture as is presented below in Figure 3.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全稱:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全稱:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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