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參數(shù)資料
| 型號： | SN2005118412ZHK |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCMCIA BUS CONTROLLER, PBGA216 |
| 封裝： | GREEN, PLASTIC, MICRO BGA-216 |
| 文件頁數(shù)： | 240/271頁 |
| 文件大小： | 3240K |
| 代理商： | SN2005118412ZHK |
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Principles of Operation
54
September 2005
SCPS110
SDA
SCL
Start
Condition
Stop
Condition
Change of
Data Allowed
Data Line Stable,
Data Valid
Figure 37. Serial-Bus Start/Stop Conditions and Bit Transfers
Data is transferred serially in 8-bit bytes. The number of bytes that may be transmitted during a data transfer
is unlimited; however, each byte must be completed with an acknowledge bit. An acknowledge (ACK) is
indicated by the receiver pulling the SDA signal low, so that it remains low during the high state of the SCL
signal. Figure 38 illustrates the acknowledge protocol.
SCL From
Master
123
78
9
SDA Output
By Transmitter
SDA Output
By Receiver
Figure 38. Serial-Bus Protocol Acknowledge
The controller is a serial bus master; all other devices connected to the serial bus external to the controller
are slave devices. As the bus master, the controller drives the SCL clock at nearly 100 kHz during bus cycles
and places SCL in a high-impedance state (zero frequency) during idle states.
Typically, the controller masters byte reads and byte writes under software control. Doubleword reads are
performed by the serial EEPROM initialization circuitry upon a PCI reset and may not be generated under
software control. See Section 3.6.4, Serial-Bus EEPROM Application, for details on how the controller
automatically loads the subsystem identification and other register defaults through a serial-bus EEPROM.
Figure 39 illustrates a byte write. The controller issues a start condition and sends the 7-bit slave device
address and the command bit zero. A 0b in the R/W command bit indicates that the data transfer is a write.
The slave device acknowledges if it recognizes the address. If no acknowledgment is received by the
controller, then an appropriate status bit is set in the serial-bus control/status register (PCI offset B3h, see
Section 4.49). The word address byte is then sent by the controller, and another slave acknowledgment is
expected. Then the controller delivers the data byte MSB first and expects a final acknowledgment before
issuing the stop condition.
Sb6
b4
b5
b3 b2 b1 b0
0
b7 b6 b5 b4 b3
b2 b1 b0
AA
Slave Address
Word Address
R/W
S/P = Start/Stop Condition
A = Slave Acknowledgement
b7 b6
b4
b5
b3 b2 b1 b0
A
P
Data Byte
Figure 39. Serial-Bus Protocol—Byte Write
相關PDF資料 |
PDF描述 |
|---|---|
| SNA7412ZHK | PCMCIA BUS CONTROLLER, PBGA216 |
| SN260Q | LOCAL AREA NETWORK CONTROLLER, QCC40 |
| SN54128J | TTL/H/L SERIES, QUAD 2-INPUT NOR GATE, CDIP14 |
| SNJ54128W | TTL/H/L SERIES, QUAD 2-INPUT NOR GATE, CDFP14 |
| SN54132J | TTL/H/L SERIES, QUAD 2-INPUT NAND GATE, CDIP14 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SN200512N | 制造商:Texas Instruments 功能描述: |
| SN200513N | 制造商:Texas Instruments 功能描述: |
| SN200515N | 制造商:Texas Instruments 功能描述: |
| SN200520N | 制造商:Texas Instruments 功能描述: |
| SN200530DR | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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