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參數(shù)資料
| 型號： | SN2005118412ZHK |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCMCIA BUS CONTROLLER, PBGA216 |
| 封裝： | GREEN, PLASTIC, MICRO BGA-216 |
| 文件頁數(shù)： | 214/271頁 |
| 文件大小： | 3240K |
| 代理商： | SN2005118412ZHK |
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Introduction
31
September 2005
SCPS110
Table 210. PCI Address and Data Terminals
Internal pullup/pulldown resistors and pin strapping are not applicable for the PCI address and data terminals.
TERMINAL
DESCRIPTION
I/O
INPUT
OUTPUT
POWER
NAME
NO.
DESCRIPTION
I/O
TYPE
INPUT
OUTPUT
POWER
RAIL
AD31
AD30
AD29
AD28
AD27
AD26
AD25
AD24
AD23
AD22
AD21
AD20
AD19
AD18
AD17
AD16
AD15
AD14
AD13
AD12
AD11
AD10
AD09
AD08
AD07
AD06
AD05
AD04
AD03
AD02
AD01
AD00
M01
M02
M03
M06
M05
N01
N02
N03
P03
R01
R02
P05
R03
T01
T02
W04
W07
R08
U08
V08
W09
V09
U09
R09
V10
U10
R10
W11
V11
U11
P11
R11
PCI address/data bus. These signals make up the multiplexed PCI address and data bus on the
primary interface. During the address phase of a primary-bus PCI cycle, AD31AD0 contain a
32-bit address or other destination information. During the data phase, AD31AD0 contain data.
I/O
PCII3
PCIO3
VCCP
C/BE3
C/BE2
C/BE1
C/BE0
P02
U05
V07
W10
PCI-bus commands and byte enables. These signals are multiplexed on the same PCI
terminals. During the address phase of a primary-bus PCI cycle, C/BE3C/BE0 define the bus
command. During the data phase, this 4-bit bus is used as a byte enable. The byte enable
determines which byte paths of the full 32-bit data bus carry meaningful data. C/BE0 applies to
byte 0 (AD7AD0), C/BE1 applies to byte 1 (AD15AD8), C/BE2 applies to byte 2
(AD23AD16), and C/BE3 applies to byte 3 (AD31AD24).
I/O
PCII3
PCIO3
VCCP
PAR
U07
PCI-bus parity. In all PCI-bus read and write cycles, the controller calculates even parity across
the AD31AD0 and C/BE3C/BE0 buses. As an initiator during PCI cycles, the controller
outputs this parity indicator with a one-PCLK delay. As a target during PCI cycles, the controller
compares its calculated parity to the parity indicator of the initiator. A compare error results in the
assertion of a parity error (PERR).
I/O
PCII3
PCIO3
VCCP
相關PDF資料 |
PDF描述 |
|---|---|
| SNA7412ZHK | PCMCIA BUS CONTROLLER, PBGA216 |
| SN260Q | LOCAL AREA NETWORK CONTROLLER, QCC40 |
| SN54128J | TTL/H/L SERIES, QUAD 2-INPUT NOR GATE, CDIP14 |
| SNJ54128W | TTL/H/L SERIES, QUAD 2-INPUT NOR GATE, CDFP14 |
| SN54132J | TTL/H/L SERIES, QUAD 2-INPUT NAND GATE, CDIP14 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SN200512N | 制造商:Texas Instruments 功能描述: |
| SN200513N | 制造商:Texas Instruments 功能描述: |
| SN200515N | 制造商:Texas Instruments 功能描述: |
| SN200520N | 制造商:Texas Instruments 功能描述: |
| SN200530DR | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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