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參數(shù)資料
| 型號： | M30956FKTGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 67/579頁 |
| 文件大?。?/td> | 12750K |
| 代理商： | M30956FKTGP |
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13. DMACII
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13.1.3
Interrupt Control Register for the Peripheral Function
To use the peripheral function interrupt as a DMACII request source, set bits ILVL2 to ILVL0 to 111b (level 7).
13.1.4
Relocatable Vector Table for the Peripheral Function
Set the start address of the DMACII index in an interrupt vector of the peripheral function interrupt used as a
DMACII request source. When using the chain transfer, the relocatable vector table must be located in the
RAM.
13.1.5
IRLT Bit in the IIOiIE Register (i = 0 to 11)
When the intelligent I/O interrupt, CAN interrupt, INTj (j = 6 to 8), UARTk (k = 5, 6) transmit interrupt, or
UARTk receive interrupt is used to activate DMACII, the IRLT bit in the corresponding IIOiIE register must be
set to 0 (interrupt request is used for DMAC, DMACII).
13.2
DMACII Performance
The DMACII function is selected by setting the DMAII bit to 1 (interrupt priority level 7 is used for DMACII
transfer). DMACII transfer request is generated by interrupt requests from any peripheral function with bits ILVL2
to ILVL0 set to 111b (level 7). These peripheral function interrupt request signals become DMACII transfer
request signals and the peripheral function interrupt cannot be used.
When an interrupt request with bits ILVL2 to ILVL0 set to 111b (level 7) is generated, DMACII is activated
regardless of I flag and IPL settings.
13.3
Transfer Data
DMACII transfers 8-bit or 16-bit data.
Memory-to-memory transfer: data is transferred from a given memory location in the 64-Kbyte space
(addresses 00000h to 0FFFFh) to another given memory location in the same space.
Immediate data transfer: immediate data is transferred to a given memory location in the 64-Kbyte space.
Calculation transfer: two 8-bit data or two 16 bit data are added together and the result is transferred to a given
memory location in the 64-Kbyte space.
When a 16-bit data is transferred to a destination address 0FFFFh, it is transferred to addresses 0FFFFh and
10000h. Likewise, when a source address is 0FFFFh, a 16-bit data in addresses 0FFFFh and 10000h is transferred
to a given destination address.
The actual transferable space varies depending on internal RAM capacity.
13.3.1
Memory-to-memory Transfer
Data transfer between any two memory locations in the 64-Kbyte space can be:
a transfer from a fixed address to another fixed address;
a transfer from a fixed address to a incremented address;
a transfer from an incremented address to a fixed address;
a transfer from an incremented address to another incremented address.
When an incremented address is selected, DMACII increments an address after every transfer for the following
transfer. In a 8-bit data transfer, a transfer address is incremented by one. In a 16-bit data transfer, a transfer
address is incremented by two.
When a source or destination address exceeds address 0FFFFh as a result of address incrementation, the source
or destination address returns to address 00000h and continues incrementing. Maintain source and destination
address at address 0FFFFh or below.
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