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參數(shù)資料
| 型號： | M30956FKTGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 275/579頁 |
| 文件大?。?/td> | 12750K |
| 代理商： | M30956FKTGP |
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21.3.1
Single-Phase Waveform Output Mode
A high-level (“H”) signal is output from the IIOi_j pin when the base timer value matches the GiPOj register (i
= 0, 1, j = 0 to 7). A low-level (“L”) signal is output when the base timer reaches 0000h. By setting the IVL bit
in the GiPOCRj register to 1 (“H” output), an “H” signal is output when waveform output starts. By setting the
INV bit to 1 (output inverted), the output waveform level is inverted. See Figure 21.17 Single-Phase Waveform
Output Mode for details.
Table 21.8 lists specifications of single-phase waveform output mode.
Table 21.8
Single-Phase Waveform Output Mode Specifications
NOTES:
1. When the INV bit in the GiPOCRj register is set to 1 (output inverted), the “L” width and the “H” width are
inverted.
2. Set the FSCj bit in the GiFS register to 0 (waveform generation function selected).
Item
Specification
Output waveform(1)
The following applies when;
-Free-running operation (bits RST2 and RST1 in the GiBCR1 register are set
to 00b)
-Output waveform is not inverted (the INV bit in the GiPOCRj register is set to 0)
Cycle:
65536
fBTi
“L” width:
m
fBTi
“H” width:
65536 - m
fBTi
m: setting value of the GiPOj register: 0000h to FFFFh
The following applies when;
-The base timer becomes 0000h by matching the base timer value with the
GiPO0 register (bits RST2 and RST1are set to 01b)
-Output waveform is not inverted (the INV bit in the GiPOCRj register is set to 0)
Cycle :
n + 2
fBTi
“L” width:
m
fBTi
“H” width:
n + 2 - m
fBTi
m: setting value of the GiPOp register (p = 1 to 7), 0000h to FFFFh
n: setting value of the GiPO0 register, 0001h to FFFDh
If m
≥ n + 2, the output level is fixed to “L”
Waveform output start condition(2) Set the IFEj bit in the GiFE register to 1 (channel j’s function enabled)
Waveform output stop condition
Set the IFEj bit to 0 (channel j’s function disabled)
Interrupt request
The POijR bit in the interrupt request register becomes 1 (interrupt requested)
when the base timer value matches the GiPOj register. (See Figure 10.18 IIO0IR
)
IIOi_ j pin (output)
Pulse output
Selectable function
Default value set function:
The output level when waveform output starts is set
Inverse output function:
The waveform level is inverted and output from the IIOi_j pin
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