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參數(shù)資料
| 型號(hào)： | M30956FKTGP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | FLASH, 64 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件頁(yè)數(shù)： | 313/579頁(yè) |
| 文件大?。?/td> | 12750K |
| 代理商： | M30956FKTGP |
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22.1.17 CANi Single-Shot Control Register (CiSSCTLR Register) (i = 0, 1)
Figure 22.21
C0SSCTLR and C1SSCTLR Registers
Bit Name
Symbol
Address
After Reset(3)
RW
CANi Single-Shot Control Register (i = 0, 1)(1, 2)
C0SSCTLR
C1SSCTLR
0221h - 0220h
02A1h - 02A0h
0000h
Function
Bit Symbol
RW
Message slot 14
single-shot control bit
RW
Message slot 10
single-shot control bit
b7
b8
b15
b0
RW
Message slot 11
single-shot control bit
RW
SSC15
SSC14
SSC13
SSC11
SSC10
SSC12
SSC5
NOTES:
1. Set the CiSSCTLR register while the CiMCTLj register (j = 0 to 15), for the corresponding message slot to the bit to be changed, is
set to 00h.
2. The CiSSCTLR register can be accessed when the BANKSEL bit in the CiCTLR1 register is set to 0 (message slot control register
and single-shot register selected).
3. The value is obtained by setting the SLEEP bit in the CiSLPR register to 1 (sleep mode exited) after reset, supplying the clock to
the CAN module, and setting the BANKSEL bit to 0.
RW
SSC9
SSC8
Message slot 9
single-shot control bit
Message slot 8
single-shot control bit
RW
SSC7
SSC6
Message slot 6
single-shot control bit
Message slot 7
single-shot control bit
RW
Message slot 4
single-shot control bit
Message slot 3
single-shot control bit
Message slot 1
single-shot control bit
Message slot 2
single-shot control bit
SSC4
SSC3
SSC2
SSC1
Message slot 0
single-shot control bit
RW
SSC0
Message slot 15
single-shot control bit
Message slot 12
single-shot control bit
Message slot 13
single-shot control bit
Message slot 5
single-shot control bit
0: Single-shot mode not used
1: Single-shot mode used
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