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參數(shù)資料
| 型號(hào)： | PC8641MSH1333JB |
| 廠商： | E2V TECHNOLOGIES PLC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROPROCESSOR, CBGA1023 |
| 封裝： | 33 X 33 MM, 2.72 MM HEIGHT, 1 MM PITCH, ROHS COMPLIANT, CERAMIC, FC-BGA-1023 |
| 文件頁數(shù)： | 48/111頁 |
| 文件大?。?/td> | 1660K |
| 代理商： | PC8641MSH1333JB |
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0893C–HIREL–01/10
e2v semiconductors SAS 2010
PC8641 and PC8641D [Preliminary]
11. Local Bus
This section describes the DC and AC electrical specifications for the local bus interface of the PC8641.
11.1
Local Bus DC Electrical Characteristics
Table 11-1 provides the DC electrical characteristics for the local bus interface operating at OV
DD = 3.3V
DC
Note:
1. Note that the symbol OVIN, in this case, represents the OVIN symbol referenced in Table 3-1 on page 6
and Table 3-2 on page 7.
11.2
Local Bus AC Electrical Specifications
Table 11-2 describes the general timing parameters of the local bus interface at OV
DD = 3.3V DC. For
information about the frequency range of local bus see Section 19.1 ”Clock Ranges” on page 86.
Table 11-1.
Local Bus DC Electrical Characteristics (3.3V DC)
Parameter
Symbol
Min
Max
Unit
High-level input voltage
V
IH
2OV
DD + 0.3
V
Low-level input voltage
VIL
-0.3
0.8
V
Input current
(OVIN
(1) = 0V or BV
IN = BVDD)
I
IN
–± 5
A
High-level output voltage
(OVDD = min, IOH = -2 mA)
V
OH
OV
DD - 0.2
–
V
Low-level output voltage
(OVDD = min, IOL = 2 mA)
V
OL
–0.2
V
Table 11-2.
Local Bus General Timing Parameters (OV
DD = 3.3V DC)
Parameter
Configuration
Min
Max
Unit
Notes
Local bus cycle time
tLBK
7.5
–
ns
Local bus duty cycle
t
LBKH/tLBK
45
55
%
LCLK[n] skew to LCLK[m] or LSYNC_OUT
tLBKSKEW
–150
ps
Input setup to local bus clock (except LUPWAIT)
tLBIVKH1
1.8
–
ns
LUPWAIT input setup to local bus clock
t
LBIVKH2
1.7
–
ns
Input hold from local bus clock (except LUPWAIT)
tLBIXKH1
1.0
–
ns
LUPWAIT input hold from local bus clock
tLBIXKH2
1.0
–
ns
LALE output transition to LAD/LDP output
transition (LATCH hold time)
tLBOTOT
1.5
–
ns
Local bus clock to output valid (except LAD/LDP
and LALE)
tLBKHOV1
–2.0
ns
Local bus clock to data valid for LAD/LDP
tLBKHOV2
–2.2
ns
Local bus clock to address valid for LAD
t
LBKHOV3
–2.3
ns
Local bus clock to LALE assertion
t
LBKHOV4
–2.3
ns
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