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參數(shù)資料
| 型號： | UPD178F098GF-3BA-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 67/559頁 |
| 文件大?。?/td> | 3587K |
| 代理商： | UPD178F098GF-3BA-A |
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159
CHAPTER 6
16-BIT TIMER/EVENT COUNTER 0
User’s Manual U12790EJ2V0UD
(8) Conflicting operations
(a) If the read period and capture trigger input conflict
If the read period and inputting a capture trigger conflict while 16-bit capture/compare registers 00 and
01 (CR00 and CR01) are used as capture registers, the capture operation takes precedence and the read
data is undefined. However, the interrupt request flags (TMIF00/TMIF01) are set when the valid edge
is detected.
(b) If the match timing of the write period and TM0 conflict
When 16-bit capture/compare registers 00 and 01 (CR00, CR01) are used as capture registers, because
match detection cannot be performed correctly if the match timing of the write period and 16-bit timer
counter 0 (TM0) conflict, do not write to CR00 and CR01 close to the match timing.
(9) Timer operation
<1> Even if 16-bit timer counter 0 (TM0) is read, its value is not captured to 16-bit capture/compare register
01 (CR01).
<2> While the timer is stopped, signals input to the TI00 and TI01 pins are not accepted regardless of the
operating mode of the CPU.
<3> The one-shot pulse output operates correctly only in the free-running mode or the mode in which TM0
is cleared and started at the valid edge of TI00. In the mode in which TM0 is cleared and started on
a match between TM0 and CR00, the one-shot operation cannot be performed because TM0 does not
overflow.
(10) Capture operation
<1>
If the TI00 valid edge is specified as the count clock, a capture operation by the capture register specified
as the trigger for TI00 is not possible.
<2>
If both the rising and falling edges are selected as the valid edges of TI00, CR00 does not perform a capture
operation.
<3>
To ensure the reliability of the capture operation, the capture trigger requires a pulse longer than two cycles
of the count clock selected by prescaler mode register 0 (PRM0).
Figure 6-36. CR01 Capture Operation with Rising Edge Specified
<4>
The capture operation is performed at the fall of the count clock. Interrupt request input (INTTM00,
INTTM01), however, occurs at the rise of the next count clock.
Count clock
TM0
TI00
Rising edge detection
CR01
INTTM01
N–3N–2N–1
N
N+1
N
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD17P136BGT | MICROCONTROLLER, PDSO28 |
| UPD1913C | Consumer IC |
| UPD1943G | Consumer IC |
| UPD1962C | Peripheral IC |
| UPD1963C | Peripheral IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD178F124 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:78K/0 Series for Instructions | User＇s Manual[10/2001] |
| UPD178F124GC8BT | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| UPD178F124GF3B9 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
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| UPD178P018A | 制造商:NEC 制造商全稱:NEC 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLER |
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