參數(shù)資料
型號： UPD178F098GF-3BA-A
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, PLASTIC, QFP-100
文件頁數(shù)： 179/559頁
文件大?。?/td> 3587K
代理商： UPD178F098GF-3BA-A
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26
User’s Manual U12790EJ2V0UD
18-6
Configuration of Program Status Word ..............................................................................................
437
18-7
Flowchart from Generation of Non-Maskable Interrupt Request to Acknowledgment ....................
439
18-8
Non-Maskable Interrupt Request Acknowledgment Timing ..............................................................
439
18-9
Non-Maskable Interrupt Request Acknowledgment Operation .........................................................
440
18-10
Interrupt Request Acknowledgment Processing Algorithm ...............................................................
442
18-11
Interrupt Request Acknowledgment Timing (Minimum Time) ...........................................................
443
18-12
Interrupt Request Acknowledgment Timing (Maximum Time) ..........................................................
443
18-13
Example of Multiple Interrupt Servicing .............................................................................................
446
18-14
Pending Interrupt Requests ................................................................................................................
448
19-1
Block Diagram of PLL Frequency Synthesizer ..................................................................................
451
19-2
Format of PLL Mode Select Register (PLLMD) .................................................................................
453
19-3
Format of PLL Reference Mode Register (PLLRF) ...........................................................................
454
19-4
Format of PLL Unlock FF Judge Register (PLLUL) ..........................................................................
455
19-5
Format of PLL Data Transfer Register (PLLNS) ...............................................................................
456
19-6
Configuration of Input Select Block and Programmable Divider ......................................................
457
19-7
Reference Frequency Generator Configuration ................................................................................
458
19-8
Phase Comparator, Charge Pump, and Unlock FF Configuration ...................................................
458
19-9
Relationship Between fr, fN, UP, and DW ..........................................................................................
459
19-10
Error Out Pin Configuration ................................................................................................................
460
20-1
Frequency Counter Block Diagram ....................................................................................................
468
20-2
Format of IF Counter Mode Select Register (IFCMD) ......................................................................
469
20-3
Format of IF Counter Control Register (IFCCR) ...............................................................................
470
20-4
Format of IF Counter Gate Judge Register (IFCJG) .........................................................................
470
20-5
Block Diagram of Input Pin and Mode Selection ...............................................................................
471
20-6
Gate Timing of Frequency Counter ....................................................................................................
472
20-7
Frequency Counter Input Pin Circuit ..................................................................................................
473
20-8
Gate Status When HALT Instruction Is Executed .............................................................................
473
21-1
Format of Oscillation Stabilization Time Select Register (OSTS) ....................................................
476
21-2
HALT Mode Release upon Interrupt Generation ...............................................................................
478
21-3
HALT Mode Release by RESET Input ...............................................................................................
479
21-4
STOP Mode Release by Interrupt Request Generation ....................................................................
481
21-5
Release by STOP Mode RESET Input ..............................................................................................
482
22-1
Reset Function Block Diagram ...........................................................................................................
484
22-2
Timing of Reset by RESET Input .......................................................................................................
485
22-3
Timing of Reset due to Watchdog Timer Overflow ...........................................................................
486
22-4
Timing of Reset by Power-on Clear ...................................................................................................
487
22-5
Format of POC Status Register (POCS) ...........................................................................................
491
22-6
Format of POC Status Register (POCS) ...........................................................................................
492
22-7
Format of VM45 Control Register (VM45C) ......................................................................................
492
LIST OF FIGURES (7/8)
Figure No.
Title
Page
相關(guān)PDF資料
PDF描述
UPD17P136BGT MICROCONTROLLER, PDSO28
UPD1913C Consumer IC
UPD1943G Consumer IC
UPD1962C Peripheral IC
UPD1963C Peripheral IC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
UPD178F124 制造商:未知廠家 制造商全稱:未知廠家 功能描述:78K/0 Series for Instructions | User＇s Manual[10/2001]
UPD178F124GC8BT 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller
UPD178F124GF3B9 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller
UPD178P018 制造商:NEC 制造商全稱:NEC 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLER
UPD178P018A 制造商:NEC 制造商全稱:NEC 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLER
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