- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄200641 > UPD178F098GF-3BA-A 8-BIT, FLASH, MICROCONTROLLER, PQFP100 PDF資料下載
參數(shù)資料
| 型號(hào)： | UPD178F098GF-3BA-A |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 248/559頁(yè) |
| 文件大?。?/td> | 3587K |
| 代理商： | UPD178F098GF-3BA-A |
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321
CHAPTER 14
SERIAL INTERFACE SIO1
User’s Manual U12790EJ2V0UD
In 6-byte transmission/reception (bit 6 (ARLD) and bit 7 (RE) of the automatic data transmit/receive control register
(ADTC) = 0 and 1, respectively) in basic transmit/receive mode, the buffer RAM operates as follows.
(i)
Before transmission/reception (refer to Figure 14-10 (a))
After any data has been written to SIO1 (start trigger: this data is not transferred), transmit data 1
(T1) is transferred from the buffer RAM to SIO1. When transmission of the first byte is completed,
receive data 1 (R1) is transferred from SIO1 to the buffer RAM, and the automatic data transmit/
receive address pointer (ADTP) is decremented. Then transmit data 2 (T2) is transferred from the
buffer RAM to SIO1.
(ii) 4th byte transmit/receive point (refer to Figure 14-10 (b))
Transmission/reception of the third byte is completed, and transmit data 4 (T4) is transferred from
the buffer RAM to SIO1. When transmission of the fourth byte is completed, receive data 4 (R4) is
transferred from SIO1 to the buffer RAM, and ADTP is decremented.
(iii) Completion of transmission/reception (refer to Figure 14-10 (c))
When transmission of the sixth byte is completed, receive data 6 (R6) is transferred from SIO1 to
the buffer RAM, and the interrupt request flag (CSIIF1) is set (INTCSI1 generation).
Figure 14-10. Buffer RAM Operation in 6-Byte Transmission/Reception
(in Basic Transmit/Receive Mode) (1/2)
(a) Before transmission/reception
Transmit data 1 (T1)
Transmit data 2 (T2)
Transmit data 3 (T3)
Transmit data 4 (T4)
Transmit data 5 (T5)
Transmit data 6 (T6)
FADFH
FAC5H
FAC0H
Receive data 1 (R1)
SIO1
0
CSIIF1
5
ADTP
_1
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