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參數(shù)資料
| 型號(hào)： | UPD178F098GF-3BA-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 458/559頁(yè) |
| 文件大?。?/td> | 3587K |
| 代理商： | UPD178F098GF-3BA-A |
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510
CHAPTER 24
INSTRUCTION SET
User’s Manual U12790EJ2V0UD
Mnemonic
Operands
Bytes
Operation
Instruction
Group
8-bit
operation
Clocks
Flag
Note 1
Note 2
ZAC CY
SUB
A, #byte
2
4
–
A, CY
← A – byte
×× ×
saddr, #byte
3
6
8
(saddr), CY
← (saddr) – byte
×× ×
A, r
Note 3
2
4
–
A, CY
← A – r
×× ×
r, A
2
4
–
r, CY
← r – A
×× ×
A, saddr
2
4
5
A, CY
← A – (saddr)
×× ×
A, !addr16
3
8
9
A, CY
← A – (addr16)
×× ×
A, [HL]
1
4
5
A, CY
← A – (HL)
×× ×
A, [HL + byte]
2
8
9
A, CY
← A – (HL + byte)
×× ×
A, [HL + B]
2
8
9
A, CY
← A – (HL + B)
×× ×
A, [HL + C]
2
8
9
A, CY
← A – (HL + C)
×× ×
SUBC
A, #byte
2
4
–
A, CY
← A – byte – CY
×× ×
saddr, #byte
3
6
8
(saddr), CY
← (saddr) – byte – CY
×× ×
A, r
Note 3
2
4
–
A, CY
← A – r – CY
×× ×
r, A
2
4
–
r, CY
← r – A – CY
×× ×
A, saddr
2
4
5
A, CY
← A – (saddr) – CY
×× ×
A, !addr16
3
8
9
A, CY
← A – (addr16) – CY
×× ×
A, [HL]
1
4
5
A, CY
← A – (HL) – CY
×× ×
A, [HL + byte]
2
8
9
A, CY
← A – (HL + byte) – CY
×× ×
A, [HL + B]
2
8
9
A, CY
← A – (HL + B) – CY
×× ×
A, [HL + C]
2
8
9
A, CY
← A – (HL + C) – CY
×× ×
AND
A, #byte
2
4
–
A
← A byte
×
saddr, #byte
3
6
8
(saddr)
← (saddr) byte
×
A, r
Note 3
24
–
A
← A r
×
r, A
2
4
–
r
← r A
×
A, saddr
2
4
5
A
← A (saddr)
×
A, !addr16
3
8
9
A
← A (addr16)
×
A, [HL]
1
4
5
A
← A [HL]
×
A, [HL + byte]
2
8
9
A
← A [HL + byte]
×
A, [HL + B]
2
8
9
A
← A [HL + B]
×
A, [HL + C]
2
8
9
A
← A [HL + C]
×
Notes 1. When the internal high-speed RAM area is accessed or an instruction with no data access
2. When an area except the internal high-speed RAM area is accessed
3. Except "r = A"
Remarks 1. One instruction clock cycle is one cycle of the CPU clock (fCPU) selected by the PCC register.
2. This clock cycle applies to the internal ROM program.
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PDF描述 |
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