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參數(shù)資料
| 型號： | UPD178F098GF-3BA-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 316/559頁 |
| 文件大小： | 3587K |
| 代理商： | UPD178F098GF-3BA-A |
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383
CHAPTER 17
IEBus CONTROLLER (
PD178096A, 178098A, 178F098 ONLY)
User’s Manual U12790EJ2V0UD
Notes 1. The
PD178098A Subseries supports the IEBus controller when fX = 6.3 MHz. When fX = 4.5 MHz,
the IEBus controller is not supported.
2. Automatic master reprocessing: After generating the master request, if the master request is cancelled
by arbitration, etc., the bus is released and the master automatically
re-issues the master request.
Communication start preprocessing (data setting)
Setting and management of each communication
status
Writing data to transmit buffer
Reading data from receive buffer
Bit processing (modulation/demodulation, error
detection)
Field processing (generation/management)
Arbitration result detection
Parity processing (generation/error detection)
Automatic return of ACK/NACK
Automatic data reprocessing
Automatic master reprocessingNote 2
Transmission processing such as automatic slave
status transmission
Multiple-frame reception processing
17.2 Simple IEBus Controller
The
PD178098A Subseries has a newly developed IEBus controller. The functions of this IEBus controller are
limited compared with the conventional IEBus interface functions of the existing models (provided in the 78K/0 Series).
Table 17-7 compares the conventional IEBus interface functions of the existing models with the simple IEBus
interface functions of the
PD178098A Subseries.
Table 17-7. Comparison of Existing and Simple IEBus Interface Functions
Item
Conventional Functions (IEBus of 78K/0)
Simple Version (IEBus Incorporated in
PD178098A Subseries)
Communication mode Modes 0, 1, and 2
Fixed to mode 1
Internal system clock
fX = 6.0 (6.29) MHz
fX = 6.3 MHzNote 1
Internal buffer size
Transmit buffer: 33 bytes (FIFO)
Transmit/receive data register
Receive buffer: 40 bytes (FIFO)
Up to 4 frames can be received.
CPU processing
Hardware processing
Communication start preprocessing (data setting)
Setting and management of each communication
status
1-byte data write processing
1-byte data read processing
Management of transmission such as slave status
Management of multiple frames, master request
reprocessing
Bit processing (modulation/demodulation, error
detection)
Field processing (generation/management)
Arbitration result detection
Parity processing (generation/error detection)
Automatic return of ACK/NACK
Automatic data transmission reprocessing
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| UPD17P136BGT | MICROCONTROLLER, PDSO28 |
| UPD1913C | Consumer IC |
| UPD1943G | Consumer IC |
| UPD1962C | Peripheral IC |
| UPD1963C | Peripheral IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| UPD178F124 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:78K/0 Series for Instructions | User＇s Manual[10/2001] |
| UPD178F124GC8BT | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| UPD178F124GF3B9 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microcontroller |
| UPD178P018 | 制造商:NEC 制造商全稱:NEC 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLER |
| UPD178P018A | 制造商:NEC 制造商全稱:NEC 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLER |
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