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參數(shù)資料
| 型號(hào)： | S82451KX |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PQFP144 |
| 封裝： | QFP-144 |
| 文件頁數(shù)： | 34/180頁 |
| 文件大?。?/td> | 1094K |
| 代理商： | S82451KX |
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PRELIMINARY
121
A
82453KX/GX, 82452KX/GX, 82451KX/GX (MC)
2.3.27 SERRCMD—SYSTEM ERROR REPORTING COMMAND REGISTER
Address Offset:
C4–C5h
Default:
0000_0000_000x_0x0xb (x=captured at reset)
Attribute:
Read/Write
This register controls the reporting of system errors. Note that when bits[9:7] of this register are disabled, the
MC forces all ECC bits written to memory to 0. This mechanism is used to force ECC errors in the memory
array for debugging the memory error correcting/detecting circuits.
Bits
Description
15:10
Reserved.
9
450KX: Reserved.
8
450KX: Reserved.
7
450KX: Enable Memory ECC. 1=Enable. 0=Disable. This bit must be set to enable ECC on the
memory array. The memory array must be initialized before enabling memory ECC.
6
Reserved.
5
AERR# Driver Enable. 1=Enable. 0=Disable (default). This bit enables/disables reporting of parity
errors on request signals.
4
AERR# Input Enable. 1=Enable. 0=Disable. The MC captures this value from A8#.
3
BERR# Driver Enable. 1=Enable. 0=Disable (default). This enables/disables reporting of uncor-
rectable errors on the data bus or memory interface.
2
BERR# Input Enable. 1=Enable. 0=Disable. The MC captures this value from A9#.
1
BINIT# Driver Enable. 1=Enable. 0=Disable. When enabled, protocol violations are reported on
BINIT#.
0
BINIT# Input Enable. 1=Enable. 0=Disable. The MC captures this value from A10#.
450GX: Single-bit Error Correcting of Host Data Enable. 1=Enable. 0=Disable (default).
450GX: Logging Correctable Errors on the Host Data Bus Enable.1=Enable. 0=Disable
(default). When enabled, the MC logs correctable errors in data read from the host bus in the
SERRSTS Register. The MC also asserts the sideband single SBCERR#.
450GX: Logging Uncorrectable Errors on the Host Data Bus Enable. 1=Enable. 0=Disable
(default). When enabled, the MC logs uncorrectable errors in the SERRSTS Register. If BERR# is
enabled, BERR# is also be asserted. The memory array must be initialized before enabling
memory ECC.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| S82453KX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:DRAM Controller |
| S82454KX | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:PCI Bus Interface/Controller |
| S8248P12NF | 功能描述:ANTENNA 824-896MHZ 8DBI N FML RoHS:是 類別:RF/IF 和 RFID >> RF 天線 系列:* 標(biāo)準(zhǔn)包裝:1 系列:* |
| S82510 DIE | 制造商:Intel 功能描述: |
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