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參數(shù)資料
| 型號(hào)： | S82451KX |
| 廠商： | INTEL CORP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PQFP144 |
| 封裝： | QFP-144 |
| 文件頁(yè)數(shù)： | 138/180頁(yè) |
| 文件大?。?/td> | 1094K |
| 代理商： | S82451KX |
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52
PRELIMINARY
82454KX/GX (PB)
A
2.4.35 CSCONFV—CAPTURED SYSTEM CONFIGURATION VALUES REGISTER
Address Offset:
B4–B5h
Default:
XXh (X=Captured During hard reset)
Attribute:
Read Only
The register reports how the system is set up for certain functions. The values in this register are captured on
the rising edge of RESET#.
7
In-Order Queue Depth 1 Select. 1=Depth of 8. 0=Depth of 1. The value in this bit is driven on
A7#. Pentium Pro processors use an in-order queue depth of 8 if this bit is 1.
6
1M Power-on Reset Vector Select. 1=1 Mbyte. 0=4 Gbyte. The value in this bit is driven on A6#.
Pentium Pro processors use the 1 Mbyte reset vector if this bit is 1.
5
FRC Mode Enable. 1=Enable. 0=Disable. The value in this bit is driven on A5#. Pentium Pro
processors enter FRC enabled mode if this bit is 1.
4:0
Reserved.
Bits
Description
15:13
Reserved.
12:11
APIC Cluster ID. The PB captures this value from A[12:11]#.
10
BINIT# Input Enable. 1=Enable. 0=Disable. The PB captures this value from A10#.
9
BERR# Input Enable. 1=Enable. 0=Disable. The PB captures this value from A9#.
8
AERR# Input Enable. 1=Enable. 0=Disable. The PB captures this value from A8#.
7
In-Order Queue Depth 1 Select. 1=Depth of 8. 0=Depth of 1. The PB captures this value from
A7#. See EXERRCMD Register for additional signal details.
6
1M Power-on Reset Vector. 1=1 Mbyte. 0=4 Gbyte. The PB captures this value from A6#.
5
FRC Mode Enable. 1=Enable. 0=Disable. The PB captures this value from A5#.
4:0
Reserved.
Bits
Description
For the 82454GX, see the EXERRCMD Register (offset C0–C3h) for additional details.
Caution: Programming the corresponding output enable bit in the EXERRCMD Register must be
consistent with the value in this bit captured from the host bus. Otherwise, incorrect system
operations will result.
For the 82454GX, see the EXERRCMD Register (offset C0–C3h) for additional details.
Caution: Programming the corresponding output enable bit in the EXERRCMD Register must be
consistent with the value in this bit captured from the host bus. Otherwise, incorrect system
operations will result.
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PDF描述 |
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