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參數(shù)資料
| 型號(hào)： | XRT86SH328 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 69/339頁 |
| 文件大?。?/td> | 1996K |
| 代理商： | XRT86SH328 |
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PRELIMINARY
XRT86SH328
59
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
BIT [7:5] - Unused
BIT 4- Telecom Bus Interface - Detection of Parity Error Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Receive STS-1/STS-3 Telecom Bus Interface has
detected a parity error within the incoming STS-1/STS-3 data-stream since the last read of this register, as described
below.
`
0 - Indicates that the Receive STS-1/STS-3 Telecom Bus Interface has NOT detected a parity error since the last read
of this register.
`
1 - Indicates that the Receive STS-1/STS-3 Telecom Bus Interface has detected a parity error (and has generated
the Detection of Parity Error interrupt) since the last read of this register.
N
OTE
:
This register bit-field is only active if the XRT86SH328 has been configured to exchange STS-1/STS-3 data via
the Telecom Bus Interface.
BIT [3:1] - Unused
BIT 0 - Telecom Bus Interface - Detection of Parity Error Interrupt Enable
This READ/WRITE bit-field is used to either enable or disable the Receive STS-1/STS-3 Telecom Bus Interface -
Detection of Parity Error interrupt. If this interrupt is enabled, then the Receive STS-1/STS-3 Telecom Bus Interface will
generate this interrupt anytime it detects a parity error within the incoming STS-1/STS-3 data-stream.
`
0 - Disables the Receive STS-1/STS-3 Telecom Bus Interface - Detection of Parity Error interrupt.
`
1 - Enables the Receive STS-1/STS-3 Telecom Bus Interface - Detection of Parity Error interrupt.
Bits [7:0] -
General Purpose Input/Output Pin # 7 thru 0
The function of this READ/WRITE bit-field depends upon whether the GPIO_[7:0] pins are configured to be an input or
an output pin.
If GPIO_[7:0] is configured to be an input pin:
These register bits operates as a READ-ONLY bit-fields that reflects the state of the GPIO_[7:0] input pins.
If the GPIO_[7:0] input pins are pulled to a logic HIGH, then this register bit will be set to 1. Conversely, if the GPIO_7
input pin is pulled to a logic LOW, then this register bit will be set to 0.
If GPIO_[7:0] is configured to be an output pin
Tthe user can control the logic level of GPIO_[7:0] by writing the appropriate value into these bit-fields.
`
0 - Causes the GPIO_[7:0] output pins to be driven LOW.
`
1 - Causes the GPIO_[7:0] output pins to be driven HIGH.
T
ABLE
45: O
PERATION
B
LOCK
- I
NTERFACE
C
ONTROL
R
EGISTER
(A
DDRESS
= 0
X
003C)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Unused
Telecom Bus
Parity Error
Interrupt
Status
Unused
Telecom Bus
Parity Error
Interrupt
Enable
R/O
R/O
R/O
RUR
R/O
R/O
R/O
R/W
0
0
0
0
0
0
0
0
T
ABLE
46: O
PERATION
G
ENERAL
P
URPOSE
I
NPUT
/O
UTPUT
R
EGISTER
- B
YTE
0 (A
DDRESS
= 0
X
0047)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
GPIO_7
GPIO_6
GPIO_5
GPIO_4
GPIO_3
GPIO_2
GPIO_1
GPIO_0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_1 | 制造商:EXAR 制造商全稱:EXAR 功能描述:VOYAGER - E1 FRAMER + LIU REGISTER DESCRIPTION |
| XRT86SH328_2 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET TO 28-T1/21-E1 PDH MAPPER - VOYAGER PIN AND ARCHITECTURE DESC |
| XRT86SH328_3 | 制造商:EXAR 制造商全稱:EXAR 功能描述:VOYAGER - T1 FRAMER + LIU REGISTER DESCRIPTION |
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