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參數(shù)資料
| 型號(hào)： | XRT86SH328 |
| 廠商： | Exar Corporation |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁(yè)數(shù)： | 211/339頁(yè) |
| 文件大小： | 1996K |
| 代理商： | XRT86SH328 |
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PRELIMINARY
XRT86SH328
201
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
BIT [7:0] - See
Table 258
above, for Bit descriptions, substituting Channel 5 for Channel 1.
BIT [7:0] - See
Table 258
above, for Bit descriptions, substituting Channel 6 for Channel 1.
BIT [7:0] - See
Table 258
above, for Bit descriptions, substituting Channel 7 for Channel 1.
BIT7 - Force Receive DS1/E1 AIS - DS1/E1 Channel 4
This READ/WRITE bit-field is used to force the M12 De-MUX Block (associated with DS2 Channel # 0) to overwrite the
Egress Direction or De-Multiplexed DS1/E1 Signal associated with DS1/E1 Channel 4, with a DS1/E1 AIS Pattern as it is
de-muxing this DS1/E1 signal from the incoming DS2 data-stream, as described below.
`
0 - Configures the M12 De-MUX block to NOT transmit the DS1/E1 AIS Pattern, via Egress Direction DS1/E1 Channel
4.
`
1 - Configures the M12 De-MUX block to transmit the DS1/E1 AIS Pattern, via Egress Direction DS1/E1 Channel 4.
T
ABLE
262: DS3 F
RAMER
B
LOCK
- M12 C
ONFIGURATION
R
EGISTER
- DS2 C
HANNEL
# 5 (A
DDRESS
= 0
X
0E1E)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Reserved
Set G.747
Mode
Set G.747
Reserved Bit
M12 FERF
Bit Setting
M12 Loop-back Code[1:0]
R/O
R/O
R/O
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
263: DS3 F
RAMER
B
LOCK
- M12 C
ONFIGURATION
R
EGISTER
- DS2 C
HANNEL
# 6 (A
DDRESS
= 0
X
0E1F)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Reserved
Set G.747
Mode
Set G.747
Reserved Bit
M12 FERF
Bit Setting
M12 Loop-back Code[1:0]
R/O
R/O
R/O
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
264: DS3 F
RAMER
B
LOCK
- M12 C
ONFIGURATION
R
EGISTER
- DS2 C
HANNEL
# 7 (A
DDRESS
= 0
X
0E20)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Reserved
Set G.747
Mode
Set G.747
Reserved Bit
M12 FERF
Bit Setting
M12 Loop-back Code[1:0]
R/O
R/O
R/O
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
T
ABLE
265: DS3 F
RAMER
B
LOCK
- M12 D
E
-MUX F
ORCE
DS1/E1 AIS R
EGISTER
- DS2 C
HANNEL
# 1 (A
DDRESS
=
0
X
0E21)
BIT7
BIT6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
Force
Receive
DS1/E1 AIS
- DS1/E1
Channel 4
Force
Receive
DS1/E1 AIS
- DS1/E1
Channel 3
Force
Receive
DS1/E1 AIS
- DS1/E1
Channel 2
Force
Receive
DS1/E1 AIS
- DS1/E1
Channel 1
Force
Transmit
DS1/E1 AIS
- DS1/E1
Channel 4
Force
Transmit
DS1/E1 AIS
- DS1/E1
Channel 3
Force
Transmit
DS1/E1 AIS
- DS1/E1
Channel 2
Force
Transmit
DS1/E1 AIS
- DS1/E1
Channel 1
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_1 | 制造商:EXAR 制造商全稱:EXAR 功能描述:VOYAGER - E1 FRAMER + LIU REGISTER DESCRIPTION |
| XRT86SH328_2 | 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET TO 28-T1/21-E1 PDH MAPPER - VOYAGER PIN AND ARCHITECTURE DESC |
| XRT86SH328_3 | 制造商:EXAR 制造商全稱:EXAR 功能描述:VOYAGER - T1 FRAMER + LIU REGISTER DESCRIPTION |
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