參數(shù)資料
型號(hào): XRT86SH328
廠商: Exar Corporation
元件分類: 通信及網(wǎng)絡(luò)
英文描述: Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
中文描述: Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0
文件頁數(shù): 121/339頁
文件大?。?/td> 1996K
代理商: XRT86SH328
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PRELIMINARY
XRT86SH328
111
REV. P1.0.6
28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET APPLICATIONS
N
OTE
:
An AIS Pointer is defined as a condition in which both the H1 and H2 bytes (within the TOH) are each set to an
All Ones pattern.
`
0 - Indicates that the Detection of AIS Pointer interrupt has NOT occurred since the last read of this register.
`
1 - Indicates that the Detection of AIS Pointer interrupt has occurred since the last read of this register.
BIT 3 - Detection of Pointer Change Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Detection of Pointer Change Interrupt has occurred since
the last read of this register.If this interrupt is enabled, then the Receive STS-1 POH Processor block will generate an
interrupt anytime it accepts a new pointer value (e.g., H1 and H2 bytes, in the TOH bytes).
`
0 - Indicates that the Detection of Pointer Change Interrupt has NOT occurred since the last read of this register.
`
1 - Indicates that the Detection of Pointer Change Interrupt has occurred since the last read of this register.
BIT 2 - Unused
BIT 1 - Change in TIM-P (Trace Identification Mismatch) Defect Condition Interrupt
This RESET-upon-READ bit-field indicates whether or not the Change in TIM-P Defect Condition interrupt has occurred
since the last read of this register.If this interrupt is enabled, then the Receive STS-1 POH Processor block will generate
an interrupt in response to either of the following events.
Whenever the Receive STS-1 POH Processor block declares the TIM-P defect condition.
Whenever the Receive STS-1 POH Processor block clears the TIM-P defect condition.
`
0 - Indicates that the Change in TIM-P Defect Condition Interrupt has not occurred since the last read of this register.
`
1 - Indicates that the Change in TIM-P Defect Condition Interrupt has occurred since the last read of this register.
BIT 0 - Change in Path Trace Identification Message Unstable Defect Condition Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the Change in Path Trace Message Unstable Defect
Condition Interrupt has occurred since the last read of this register.If this interrupt is enabled, then the Receive STS-1
POH Processor block will generate this interrupt in response to either of the following events.
Whenever the Receive STS-1 POH Processor block declare the Path Trace Message Unstable Defect
Condition.
Whenever the Receive STS-1 POH Processor block clears the Path Trace Message Unstable defect
condition.
`
0 - Indicates that the Change in Path Trace Message Unstable Defect Condition Interrupt has NOT occurred since
the last read of this register.
`
1 - Indicates that the Change in Path Trace Message Unstable Defect Condition Interrupt has occurred since the last
read of this register.
BIT 7 -
New Path Trace Message Interrupt Status
This RESET-upon-READ bit-field indicates whether or not the New Path Trace Message Interrupt has occurred since
the last read of this register.
T
ABLE
135: R
ECEIVE
STS-1 P
ATH
- SONET R
ECEIVE
P
ATH
I
NTERRUPT
S
TATUS
- B
YTE
1 (A
DDRESS
L
OCATION
=
0
X
028A)
BIT 7
BIT 6
BIT 5
BIT 4
BIT 3
BIT 2
BIT 1
BIT 0
New Path
Trace
Message
Interrupt
Status
Detection of
REI-P Event
Interrupt
Status
Change in
UNEQ-P
Defect
Condition
Interrupt
Status
Change in
PLM-P
Defect
Condition
Interrupt
Status
New
C2 Byte
Interrupt
Status
Change in
C2 Byte
Unstable
Defect
Condition
Interrupt
Status
Change in
RDI-P
Unstable
Defect
Condition
Interrupt
Status
New RDI-P
Value
Interrupt
Status
RUR
RUR
RUR
RUR
RUR
RUR
RUR
RUR
0
0
0
0
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0
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PDF描述
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XRT86SH328_2 制造商:EXAR 制造商全稱:EXAR 功能描述:SONET TO 28-T1/21-E1 PDH MAPPER - VOYAGER PIN AND ARCHITECTURE DESC
XRT86SH328_3 制造商:EXAR 制造商全稱:EXAR 功能描述:VOYAGER - T1 FRAMER + LIU REGISTER DESCRIPTION