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參數(shù)資料
| 型號： | T7230A |
| 廠商： | Lineage Power |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 68/110頁 |
| 文件大小： | 752K |
| 代理商： | T7230A |
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Preliminary Data Sheet
T7230A Primary Access Framer/Controller
June 1997
64
Lucent Technologies Inc.
Concentration Highway Interface (CHI)
(continued)
CHI Offset Programming
(continued)
Figure 16 shows an example of the relative timing of CHI 2.048 Mbits/s data with the following parameters:
1.
2.
3.
CMS = 0, FE = 0.
XCE = 1, XOFF[2:0] = 000, XBYOFF[5:0] = 000000, XLBIT = 1,
RCE = 0 , ROFF[2:0] = 000, RBYOFF[5:0] = 000000, RLBIT = 1.
5-2202(F).a
Figure 16. CHI DX and DR to CLKXR Relationship with CMS = 0 (CEX = 3 and CER = 4, Respectively)
Figure 17 shows an example of the relative timing of CHI 2.048 Mbits/s data with the following parameters:
1.
2.
3.
CMS =1, FE = 0.
XCE = 1, XOFF[2:0] = 000, XBYOFF[5:0] = 000000, XLBIT = 1,
RCE = 0 , ROFF[2:0] = 000, RBYOFF[5:0] = 000000, RLBIT = 1.
5-2203(F).a
Figure 17. CHI DX and DR to CLKXR Relationship with CMS = 1 (CEX = 3 and CER = 6, Respectively)
FS IS SAMPLED ON THIS EDGE: FE = 0
1
2
3
4
5
6
7
8
BIT0, TS0
BIT1, TS0
BIT2, TS0
CEX = 3
CER = 4
BIT0, TS0
BIT1, TS0
BIT2, TS0
3-STATE
DON’T CARE
DR: RCE = 0
DX: XCE = 1
FS
CLKXR
FS IS SAMPLED ON THIS EDGE: FE = 0
1
2
3
4
5
6
7
8
BIT0, TS0
BIT1, TS0
BIT2, TS0
CEX = 3
CER = 6
BIT0, TS0
BIT1, TS0
3-STATE
DON’T CARE
DR: RCE = 0
DX: XCE = 1
FS
CLKXR
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參數(shù)描述 |
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