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參數(shù)資料
| 型號(hào)： | PC87413 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | LPC ServerI/O for Servers and Workstations |
| 中文描述： | LPC ServerI /服務(wù)器和工作站 |
| 文件頁(yè)數(shù)： | 79/257頁(yè) |
| 文件大?。?/td> | 3163K |
| 代理商： | PC87413 |
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3.0 Device Architecture and Configuration
(Continued)
Revision 1.2
79
www.national.com
P
3.15.5
This register describes the high byte of the Base Address for user-defined I/O zone blocks 0 and 1, which are mapped to
the X-Bus. This register is reset by hardware to 00h.
Power Well:V
SB
Location:Index F1
Type:
R/W or RO
X-Bus I/O Base Address 1 High Byte Register (XIOBA1H)
Bit
Type
Description
7
RW1L
LOCKIOMP (Lock I/O Address Map).
When set to 1, this bit locks the configuration of registers
XIOCNF, XIOBA1H, XIOBA1L, XIOSIZE1, XIOBA2H, XIOBA2L and XIOSIZE2 by disabling writing to all
their bits (including to the LOCKIOMP bit itself). Once set, this bit can be cleared either by V
DD
Power-
Up reset (or Hardware reset) or by V
SB
Power-Up reset, according to the VSBLOCK bit in the
ACBLKCTL register (see Section 6.3.4 on page 128). In addition, this bit is cleared by setting the
UNLOCKX bit in the ACBLKCTL register (
PC87417
).
0: R/W bits are enabled for write (default)
1: All bits are RO
6-5
-
Reserved.
4
R/W or
RO
TSTADEN (TST Debug Port Address Enable).
When set, enables the mapping of I/O address 80h to
the X-Bus space.
0: Disabled (default)
1: Enabled
3
R/W or
RO
UDIOZEN3 (User-Defined I/O Zone Enable 3).
This bit enables the mapping of the User-Defined I/O
zone 3 to the X-Bus space. The zone base address and size are defined by the XIOBA2H/XIOBA2L
and XIOSIZE2 registers, respectively.
The base address for this Zone is: (Base Address 2) + (Size 2)
0: Disabled (default)
1: Enabled
2
R/W or
RO
UDIOZEN2 (User-Defined I/O Zone Enable 2).
This bit enables the mapping of the User-Defined I/O
zone 2 to the X-Bus space. The zone base address and size are defined by the XIOBA2H/XIOBA2L
and XIOSIZE2 registers, respectively.
The base address for this Zone is: (Base Address 2)
0: Disabled (default)
1: Enabled
1
R/W or
RO
UDIOZEN1 (User-Defined I/O Zone Enable 1).
This bit enables the mapping of the User-Defined I/O
zone 1 to the X-Bus space. The zone base address and size are defined by the XIOBA1H/XIOBA1L
and XIOSIZE1 registers, respectively.
The base address for this Zone is: (Base Address 1) + (Size 1)
0: Disabled (default)
1: Enabled
0
R/W or
RO
UDIOZEN0 (User-Defined I/O Zone Enable 0).
This bit enables the mapping of the User-Defined I/O
zone 0 to the X-Bus space. The zone base address and size are defined by the XIOBA1H/XIOBA1L
and XIOSIZE1 registers, respectively.
The base address for this Zone is: (Base Address 1)
0: Disabled (default)
1: Enabled
Bit
Name
Reset
7
6
5
4
3
2
1
0
IOBA1H
0
0
0
0
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PC87414 | LPC ServerI/O for Servers and Workstations |
| PC87416 | LPC ServerI/O for Servers and Workstations |
| PC87417 | LPC ServerI/O for Servers and Workstations |
| PC87415 | PCI-IDE DMA Master Mode Interface Controller |
| PC87415VCG | PCI-IDE DMA Master Mode Interface Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PC87414 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:LPC ServerI/O for Servers and Workstations |
| PC87415 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:PCI-IDE DMA Master Mode Interface Controller |
| PC87415VCG | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| PC87416 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:LPC ServerI/O for Servers and Workstations |
| PC87417 | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:LPC ServerI/O for Servers and Workstations |
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