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參數(shù)資料
| 型號： | PC87413 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | LPC ServerI/O for Servers and Workstations |
| 中文描述： | LPC ServerI /服務(wù)器和工作站 |
| 文件頁數(shù)： | 186/257頁 |
| 文件大?。?/td> | 3163K |
| 代理商： | PC87413 |
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9.0 System Wake-Up Control (SWC)
(Continued)
www.national.com
186
Revision1.2
P
9.3.9
This register provides a fast way for the Power Management software to float the outputs of one or more modules without
having to access their TRI-STATE Control bit in the Special Configuration register at index F0h. The module outputs enter
TRI-STATE only when the module is disabled (see Section 9.3.8). The register is reset by hardware to 00h.
Power Well:V
SB
Location:
All Banks
, Offset 07h
Type:
R/W
SWC TRI-STATE Register (SWCTRIS)
Bit
Name
Reset
7
6
5
4
3
2
1
0
Reserved
0
KBMSTRIS
0
SER1TRIS
0
SER2TRIS
0
PARPTRIS
0
FDCTRIS
0
0
0
Bit
Description
7-5
Reserved.
4
KBMSTRIS (Keyboard and Mouse Outputs TRI-STATE).
When set to 1 and the module is disabled, this bit
forces the outputs of the Keyboard and Mouse Controller to be in TRI-STATE regardless of bit 0 in the Keyboard
Configuration register (see Section 3.13.3 on page 69).
0: Enabled or Disabled, according to bit 0 in the Keyboard Configuration register (default)
1: Outputs in TRI-STATE
3
SER1TRIS (Serial Port 1 Outputs TRI-STATE).
When set to 1 and the module is disabled, this bit forces the
outputs of the Serial Port 1 module to be in TRI-STATE regardless of bit 0 in the Serial Port 1 Configuration
register (see Section 3.11.3 on page 66).
0: Enabled or Disabled, according to bit 0 in the Serial Port 1 Configuration register (default)
1: Outputs in TRI-STATE
2
SER2TRIS (Serial Port 2 Outputs TRI-STATE).
When set to 1 and the module is disabled, this bit forces the
outputs of the Serial Port 2 module to be in TRI-STATE regardless of bit 0 in the Serial Port 2 Configuration
register (see Section 3.10.3 on page 64).
0: Enabled or Disabled, according to bit 0 in the Serial Port 2 Configuration register (default)
1: Outputs in TRI-STATE
1
PARPTRIS (Parallel Port Outputs TRI-STATE).
When set to 1 and the module is disabled, this bit forces the
outputs of the Parallel Port module to be in TRI-STATE regardless of bit 0 in the Parallel Port Configuration
register (see Section 3.9.3 on page 62).
0: Enabled or Disabled, according to bit 0 in the Parallel Port Configuration register (default)
1: Outputs in TRI-STATE
0
FDCTRIS (Floppy Disk Controller Outputs TRI-STATE).
When set to 1 and the module is disabled, this bit
forces the outputs of the Floppy Disk Controller module to be in TRI-STATE regardless of bit 0 in the FDC
Configuration register (see Section 3.8.3 on page 59).
0: Enabled or Disabled, according to bit 0 in the FDC Configuration register (default)
1: Outputs in TRI-STATE
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PDF描述 |
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