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參數(shù)資料
| 型號： | PC87413 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | LPC ServerI/O for Servers and Workstations |
| 中文描述： | LPC ServerI /服務器和工作站 |
| 文件頁數(shù)： | 177/257頁 |
| 文件大?。?/td> | 3163K |
| 代理商： | PC87413 |
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9.0 System Wake-Up Control (SWC)
(Continued)
Revision 1.2
177
www.national.com
P
Table 44. Bank 0 - Keyboard/Mouse Wake-Up Detector Register Map
Offset
Mnemonic
Register Name
Type
Power Well Section
10h-11h Reserved
12h
KBDWKCTL
Keyboard Wake-Up Control
R/W
V
PP
9.3.16
13h
PS2CTL
PS2 Protocol Control
R/W
V
PP
9.3.17
14h-15h Reserved
16h
KDSR
Keyboard Data Shift-Register
RO
V
PP
9.3.18
17h
MDSR
Mouse Data Shift-Register
RO
V
PP
9.3.19
18h
PS2KEY0
PS2 Keyboard Key Data 0
R/W
V
PP
9.3.20
19h
PS2KEY1
PS2 Keyboard Key Data 1
R/W
V
PP
9.3.20
1Ah
PS2KEY2
PS2 Keyboard Key Data 2
R/W
V
PP
9.3.20
1Bh
PS2KEY3
PS2 Keyboard Key Data 3
R/W
V
PP
9.3.20
1Ch
PS2KEY4
PS2 Keyboard Key Data 4
R/W
V
PP
9.3.20
1Dh
PS2KEY5
PS2 Keyboard Key Data 5
R/W
V
PP
9.3.20
1Eh
PS2KEY6
PS2 Keyboard Key Data 6
R/W
V
PP
9.3.20
1Fh
PS2KEY7
PS2 Keyboard Key Data 7
R/W
V
PP
9.3.20
Table 45. Bank 1 - Power Active Timers Register Map
Offset
Mnemonic
Register Name
Type
Power Well Section
10h
VDD_ON_TMR_0
V
DD
Active Timer 0
RO
V
PP
9.3.21
11h
VDD_ON_TMR_1
V
DD
Active Timer 1
RO
V
PP
9.3.22
12h
VDD_ON_TMR_2
V
DD
Active Timer 2
RO
V
PP
9.3.23
13h
VDD_ON_TMR_3
V
DD
Active Timer 3
RO
V
PP
9.3.24
14h
VSB_ON_TMR_0
V
SB
Active Timer 0
RO
V
PP
9.3.25
15h
VSB_ON_TMR_1
V
SB
Active Timer 1
RO
V
PP
9.3.26
16h
VSB_ON_TMR_2
V
SB
Active Timer 2
RO
V
PP
9.3.27
17h
VSB_ON_TMR_3
V
SB
Active Timer 3
RO
V
PP
9.3.28
18h
PWTMRCTL
Power Active Timers Control
Varies per bit
V
PP
9.3.29
19h-1Fh Reserved
相關PDF資料 |
PDF描述 |
|---|---|
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| PC87416 | LPC ServerI/O for Servers and Workstations |
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參數(shù)描述 |
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