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參數(shù)資料
| 型號(hào)： | PC87413 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | LPC ServerI/O for Servers and Workstations |
| 中文描述： | LPC ServerI /服務(wù)器和工作站 |
| 文件頁(yè)數(shù)： | 70/257頁(yè) |
| 文件大?。?/td> | 3163K |
| 代理商： | PC87413 |
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3.0 Device Architecture and Configuration
(Continued)
www.national.com
70
Revision1.2
P
3.14 GENERAL-PURPOSE INPUT/OUTPUT (GPIO) PORTS CONFIGURATION
3.14.1
The GPIO functional block includes 51 pins arranged in seven ports:
General Description
G
Ports 1 and 4 contain eight GPIOE pins each.
G
Ports 0, 2 and 3 contain eight GPIO pins each.
G
Port 5 contains six GPIO pins.
G
Port 6 contains five GPO pins (see Section 1.4.8 on page 27).
All the pins of Ports 1 and 4 and have full event detection capability (see Section 1.3 on page 20), enabling them to trigger
the assertion of IRQ or SIOSMI signals. In addition, through the SWC functional block, the pins of Ports 1 and 4 can trigger
the SIOSCI, control the ONCTL signal or enable the generation of a pulse in the PWBTOUT signal. The pins of Ports 0-5
are I/O, however the five pins of Port 6 are output only.
All 51 GPIO pins are powered from the V
SB
well. The 17 runtime registers associated with the seven ports are arranged in
the GPIO address space as shown in Table 24. The GPIO ports with wake-up event detection capability (such as Ports 1
and 4) have four runtime registers; the other ports have only 2. Port 6 contains only GPO pins and therefore has only one
runtime register. The GPIO base address is 32-byte aligned. Address bits 4-0 are used to indicate the register offset.
The specific runtime registers implemented in the PC8741x devices are shown in Table 24. All these registers are V
SB
pow-
ered.
Table 24. Runtime Registers in GPIO Address Space
Offset
Mnemonic
Register Name
Port Power Well
Type
00h
GPDO0
GPIO Data Out 0
0
V
SB
R/W
01h
GPDI0
GPIO Data In 0
V
SB
RO
02h
GPDO1
GPIO Data Out 1
1
V
SB
R/W
03h
GPDI1
GPIO Data In 1
V
SB
RO
04h
GPEVEN1 GPIO Event Enable 1
V
SB
R/W
05h
GPEVST1 GPIO Event Status 1
V
SB
R/W1C
06h
GPDO2
GPIO Data Out 2
2
V
SB
R/W
07h
GPDI2
GPIO Data In 2
V
SB
RO
08h
GPDO3
GPIO Data Out 3
3
V
SB
R/W
09h
GPDI3
GPIO Data In 3
V
SB
RO
0Ah
GPDO4
GPIO Data Out 4
4
V
SB
R/W
0Bh
GPDI4
GPIO Data In 4
V
SB
RO
0Ch
GPEVEN4 GPIO Event Enable 4
V
SB
R/W
0Dh
GPEVST4 GPIO Event Status 4
V
SB
R/W1C
0Eh
GPDO5
GPIO Data Out 5
5
V
SB
R/W
0Fh
GPDI5
GPIO Data In 5
V
SB
RO
10h
GPDO6
GPIO Data Out 6
6
V
SB
R/W
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PC87414 | LPC ServerI/O for Servers and Workstations |
| PC87416 | LPC ServerI/O for Servers and Workstations |
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| PC87415 | PCI-IDE DMA Master Mode Interface Controller |
| PC87415VCG | PCI-IDE DMA Master Mode Interface Controller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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