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參數(shù)資料
| 型號： | PC87413 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | LPC ServerI/O for Servers and Workstations |
| 中文描述： | LPC ServerI /服務(wù)器和工作站 |
| 文件頁數(shù)： | 136/257頁 |
| 文件大小： | 3163K |
| 代理商： | PC87413 |
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7.0 General-Purpose Input/Output (GPIO) Ports
(Continued)
www.national.com
136
Revision1.2
P
7.2
The basic functionality of each GPIO pin is based on four configuration bits and a bit slice of runtime registers GPDO and
GPDI. The configuration and operation of a single pin GPIOXn (pin ‘n’ in port ‘X’) is shown in Figure 36.
BASIC FUNCTIONALITY
Figure 36. GPIO Basic Functionality
7.2.1
The GPCFG1 register controls the following basic configuration options:
Port Direction - Controlled by the Output Enable bit (bit 0).
Output Type - Push-pull vs. open-drain. It is controlled by Output Buffer Type (bit 1) by enabling/disabling the upper tran-
sistor of the output buffer.
Static Pull-Up - May be added to any type of port (input, open-drain or push-pull). It is controlled by Pull-Up Control (bit 2).
Pin Lock - GPIO pin may be locked to prevent any changes in the output value and/or the output configuration. The lock
is controlled by bit 3. It disables writes to the GPDO register bits, to bits 0-3 of the GPCFG1 register (including the Lock
bit itself) and to bits 4-6 of the GPCFG2 register. Once locked, it can be released by reset or by the UNLOCKG bit in the
ACBLKCTL register (see Section 6.3.4 on page 128 -
PC87413 and PC87417
).
The GPCFG2 register controls the following basic configuration options:
Load Protection - Disables the Output Buffer (if enabled), the Static Pull-Up (if enabled) and the Input Buffer (if the Port
is not a GPO type) if the specific GPIO pin is connected to a V
DD
-powered device and the V
DD
power is not present
(No_Vdd). This function is controlled by the V
DD
-powered Load bit (bit 4).
Configuration Options
Pin
Data Out
Data In
Output
Enable
(Bit 0)
Output
Type
(Bit 1)
Lock
(Bit 3)
Static
Pull-Up
Pull-Up
Enable
Push-Pull =1
Pull-Up
Control
(Bit 2)
Read Only
Read/Write
Lock
Lock
Lock
GPIO Pin Configuration Registers 1 and 2
(GPCFG1)
ACCESS.bus
LPC Bus
V
DD
-powered
Load
(Bit 4)
Bus
Control
(Bits 6,5)
Lock
Lock
No_Vdd
(GPCFG2)
Pin
(GPDI)
(GPDO)
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PDF描述 |
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