參數(shù)資料
型號： 29KPROG
英文描述： 5-Pin, Multiple-Input, Programmable Reset ICs
中文描述： 處理器初始化和運行時服務：OSBOOT編程29,000 RISC系列
文件頁數(shù)： 86/582頁
文件大?。?/td> 2132K
代理商： 29KPROG
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62
Evaluating and Programming the 29K RISC Family
a pair of TLB registers to fully describe the address translation and access permis-
sions for the mapped page. Pages are programmable in size from 1k bytes to 8k bytes
(to 16M byte with newer 29K processors), and separate read, write and execute per-
missions can be enabled for User mode and Supervisor mode access to the mapped
page.
There is only a single 32–bit virtual address space supported. This space is
mapped to real instruction, data or I/O memory. Address translation is performed in a
single cycle which is overlapped with other processor operations. This results in the
use of an MMU not imposing any run–time performance penalties, except where
TLB misses occur and the TLB cache has to be refilled. Each TLB entry is tagged
with a per–process identifier, avoiding the need to flush TLB contents when a user–
task context switch occurs. Chapter 6 fully describes the operation of the TLB.
1.10.4 External Address Space
The 3–bus members of the 29K family support five external 32–bit address
spaces. They are:
Data Memory — accessed via the data bus.
Input/Output — also accessed via the data bus.
Instruction — accessed via the instruction bus, normally read–only.
ROM — also accessed via the instruction bus, normally read–only.
Coprocessor — accessed via both data and address busses. Note, the address
bus is only used for stores to coprocessor space. This enables 64–bit transfers
during stores and 32–bit during loads.
The address bus is used for address information when accessing all address
spaces except the coprocessor space. During load and store operations to coprocessor
space, address information can be supplied in a limited way by the OPT2–0 field of
the load and store instructions. Of course, with off–chip address decoding support,
access to coprocessor space could always be made available via a region of I/O or
data space. Coprocessors support off–chip extensions to a processor’s execution
unit(s). AMD supplied a coprocessor in the past, which was for floating–point sup-
port, the Am29027. It is possible that users could construct their own coprocessor for
some specialized support task.
Earlier sections discussed the read–only nature of the instruction bus of 3–bus
processors. Instructions are fetched along the instruction bus from either the ROM
space or the Instruction space. Access to the two 32–bit spaces is distinguished by the
IREQT processor pin. The state of this pin is determined by the RE (ROM enable) bit
of the current processor status register (CPS). This bit can be set by software or via
programmed event actions, such as trap processing. ROM space is intended for sys-
tem level support code. Typically systems do not decode this pin and the two spaces
are combined into one.
相關PDF資料
PDF描述
29W040 4 Mbit 512Kb x8, Uniform Block Low Voltage Single Supply Flash Memory
2A-50C RADIATION HARDENED HIGH EFFICIENCY, 5 AMP SWITCHING REGULATORS
2A01-T 2.0A RECTIFIER
2A02-T 2.0A RECTIFIER
2A03-T 2.0A RECTIFIER
相關代理商/技術參數(shù)
參數(shù)描述
29L06 制造商:CLARKSON 功能描述:CSN HSS SCRW/SHK RNDG CUTTER 3MM
29L10 制造商:CLARKSON 功能描述:CSN HSS SCRW/SHK RNDG CUTTER 5MM
29L102C 功能描述:固定電感器 1.0uH 4.6A Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
29L103C 功能描述:固定電感器 10uH 1.55A Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
29L104C 功能描述:固定電感器 100uH 480mA Shielded SMD RoHS:否 制造商:AVX 電感:10 uH 容差:20 % 最大直流電流:1 A 最大直流電阻:0.075 Ohms 工作溫度范圍:- 40 C to + 85 C 自諧振頻率:38 MHz Q 最小值:40 尺寸:4.45 mm W x 6.6 mm L x 2.92 mm H 屏蔽:Shielded 端接類型:SMD/SMT 封裝 / 箱體:6.6 mm x 4.45 mm
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