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參數(shù)資料
| 型號： | TMS34020 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | GRAPHICS PROCESSORS |
| 中文描述： | 圖形處理器 |
| 文件頁數(shù)： | 72/82頁 |
| 文件大?。?/td> | 1359K |
| 代理商： | TMS34020 |
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TMS34020, TMS34020A
GRAPHICS PROCESSORS
SPVS004D – MARCH 1990 – REVISED NOVEMBER 1993
72
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
PARAMETER MEASUREMENT INFORMATION
multiprocessor interface timing: GI, ALTCH, RAS, R0 and R1 (see Figure 44)
NO.
PARAMETER
’34020-32
’34020A-32
’34020A-40
UNIT
MIN
MAX
MIN
MAX
105
ta(GIV-RQV)
Access time, GI valid after R0 and R1 valid
(see Notes 5 and 6)
2tQ–40
2tQ–30
ns
j
tsu(GIV-CK1
↑
)
Setup time, GI valid before LCLK1 no longer low
(see Note 6)
40
35
ns
106
th(CK1
↑
-GIV)
td(CK2
↑
-RQV)
td(CK2H-RQNV)
5. These timings must be met to insure that the GI input is recognized on this clock cycle.
6. It is required that either specification j or specification 105 be observed for the multiprocessor interface to function correctly. It is not
necessary for both to be met.
Hold time, GI valid after LCLK1
↑
(see Note 5)
Delay time, LCLK2
↑
to R0 or R1 valid
0
0
ns
107
tQ+15
tQ+13.5
ns
108
Delay time, LCLK2 high to R0 or R1 no longer valid
tQ–15
tQ–13.5
ns
NOTES:
GI
R0–R1
LCLK2
LCLK1
106
105
Q4*
Q1
Q2
Q3
Q4*
Q1
Q2
Q3
Q4*
Q1
Q2
Q3
Q4*
Q1
Valid
Valid
108
107
j
*See clock stretch, page 21.
Figure 44. Multiprocessor Interface Timing: GI, ALTCH, RAS, R0 and R1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMS3450NL | LED DUPLEX DIGITAL RADIO CLOCK |
| TMS3471CFS | 780- 】 488-pixel ccd image sensor |
| TMS3471 | 2/3-INCH NTSC TIMER |
| TMS3473 | PARALLEL DRIVER |
| TMS370C036A | 8-BIT MICROCONTROLLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMS3450NL | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3459BNL | 制造商:Panasonic Industrial Company 功能描述:IC |
| TMS3471C | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3472ADW | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3637D | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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