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參數資料
| 型號： | TMS34020 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | GRAPHICS PROCESSORS |
| 中文描述： | 圖形處理器 |
| 文件頁數： | 32/82頁 |
| 文件大小： | 1359K |
| 代理商： | TMS34020 |
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TMS34020, TMS34020A
GRAPHICS PROCESSORS
SPVS004D – MARCH 1990 – REVISED NOVEMBER 1993
32
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
Q4
Q1
Q2
Q3
Q4*
Q1
Q2
Q3
Q4
Q1
Q2
Q3
Q4*
Q1
PMASK Row
PMASK Address
PMASK Data
Zero Address
Q2
Q3
Q4
Q1
Not PMASK Data
PMASK Column
All-Zero Address
Write to the PMASK I/O Register
Load-Write-Mask Cycle
GI
LAD
CAMD
RCA
ALTCH
RAS
CAS
WE
TR/QE
SF
DDIN
DDOUT
LRDY
PGMD
SIZE16
BUSFLT
R0
R1
*See clock stretch, page 21.
Figure 9. Load Write Mask Cycle
This special 1M VRAM control cycle is executed when the VEN bit in the CONFIG I/O register is set and PMASKL
and/or PMASKH are written. This cycle is indicated by CAS, WE, TR/QE, and SF high at the falling edge of RAS
and SF low at the falling edge of CAS. As the plane mask is copied to the PMASK register(s), it is also output
on the LAD bus to be written to a special register on the VRAM that is used in subsequent cycles requiring a
write mask. During the address portion of the cycle, the status on LAD0–LAD3 indicates a write-mask load is
being performed (status code = 0110). Although CAMD, PGMD, and SIZE16 are ignored on this cycle, they
should be held at valid levels as shown.
相關PDF資料 |
PDF描述 |
|---|---|
| TMS3450NL | LED DUPLEX DIGITAL RADIO CLOCK |
| TMS3471CFS | 780- 】 488-pixel ccd image sensor |
| TMS3471 | 2/3-INCH NTSC TIMER |
| TMS3473 | PARALLEL DRIVER |
| TMS370C036A | 8-BIT MICROCONTROLLER |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TMS3450NL | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3459BNL | 制造商:Panasonic Industrial Company 功能描述:IC |
| TMS3471C | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3472ADW | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3637D | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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