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參數(shù)資料
| 型號(hào)： | TMS34020 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | GRAPHICS PROCESSORS |
| 中文描述： | 圖形處理器 |
| 文件頁(yè)數(shù)： | 62/82頁(yè) |
| 文件大?。?/td> | 1359K |
| 代理商： | TMS34020 |
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TMS34020, TMS34020A
GRAPHICS PROCESSORS
SPVS004D – MARCH 1990 – REVISED NOVEMBER 1993
62
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251–1443
PARAMETER MEASUREMENT INFORMATION
host interface timing responses (random read cycle) (see Figure 37)
NO.
PARAMETER
’34020-32
’34020A-32
’34020A-40
UNIT
MIN
30
MAX
MIN
25
MAX
33
tsu(RDL-CK2
↓
)
Setup time, later of HCS low or HREAD low to LCLK2
↓
Delay time from LCLK1
↑
to HRDY high (end of read
cycle)
ns
39
td(CK1
↑
-RYH)
tQ+20
tQ+18
ns
40
td(RDH-RYL)
Delay time from earlier of HREAD or HCS high to HRDY
low
20
18
ns
41
td(CK2
↓
-STL)
td(CK1
↓
-STH)
tsu(STL-RY
↑
)
td(RY
↑
-STH)
th(STH-CTV)
Delay time from LCLK2
↓
to HDST low
Delay time from LCLK1
↓
to HDST high
Setup time of HDST low to HRDY
↑
Delay time from HRDY
↑
to HDST high
tQ+15+ s
tQ+15
tQ+13.5+ s
tQ+13.5
ns
42
ns
43
tQ–15
tQ–13.5
ns
44
2tQ+15
2tQ+13.5
ns
50
Hold time, CAS, TR/QE, DDIN valid after HDST high
0
– 2
ns
Setup time to insure recognition of input on this clock edge.
Q4*
Q1
Q2
Q3
Q4*
Q1
Q2
Q3
Q4*
LCLK1
LCLK2
HCS/HREAD
HRDY
HDST
CAS
TR/QE
DDIN
33
43
33
26
40
41
39
42
44
50
*See clock stretch, page 21.
Figure 37. Host Interface Timing Responses (Random Read Cycle)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TMS3450NL | LED DUPLEX DIGITAL RADIO CLOCK |
| TMS3471CFS | 780- 】 488-pixel ccd image sensor |
| TMS3471 | 2/3-INCH NTSC TIMER |
| TMS3473 | PARALLEL DRIVER |
| TMS370C036A | 8-BIT MICROCONTROLLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TMS3450NL | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3459BNL | 制造商:Panasonic Industrial Company 功能描述:IC |
| TMS3471C | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3472ADW | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| TMS3637D | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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