參數(shù)資料
型號(hào)： AMD-640
廠商： Advanced Micro Devices, Inc.
英文描述： 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器))
中文描述： 64位Socket 7的接口，集成寫(xiě)回高速緩沖存儲(chǔ)器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和的PCI總線控制器））
文件頁(yè)數(shù)： 94/159頁(yè)
文件大小： 1900K
代理商： AMD-640
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Initialization
6-1
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
6
Initialization
All programmable features in the AMD-640 system controller
are controlled by the PCI configuration registers, which are
normally written to only during system initialization. This
section summarizes the register functions, default values,
access types, and addresses (offset numbers). For more
detailed descriptions of the configuration registers, see
Section 7.
Recommended values are shown for FPM, EDO, and SDRAM.
These values ensure acceptable performance but may not be
optimal for a particular system. Refer to the BIOS guide for
sample code.
Access types are indicated as follows:
R/W
R/O
RWC
Read, Write 1’s to Clear individual bits
Read/Write
Read Only
Table 6-1.
Configuration Space Header Registers
Offset
01h–00h
03h–02h
05h–04h
07h–06h
08h
09h
0Ah
0Bh
0Ch
0Dh
0Eh
0Fh
10h–3Fh
Note:
1. nn changes for each device revision. Rev D = 02h is the current revision as of publication of
this document (Rev E = 03h, Rev F = 04h).
PCI Header
Default
1106h
0595h
0007h
02A0h
nn (note 1)
00h
00h
06h
00h
00h
00h
00h
00h
Access
RO
RO
RW
RWC
RO
RO
RO
RO
RO
RW
RO
RO
—
Vendor ID
Device ID
Command
Status
Revision ID
Program Interface
Bus Class Code
Base Class Code
Cache Line Size
Latency Timer
Header Type
Built-In Self Test (BIST)
Reserved
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PDF描述
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