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參數(shù)資料
| 型號(hào)： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲(chǔ)器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 4/159頁 |
| 文件大小： | 1900K |
| 代理商： | AMD-640 |
第1頁第2頁第3頁當(dāng)前第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁
Table of Contents
iii
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
Contents
1
Features
1-1
1.1
Processor Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .1-1
1.2
Integrated Cache Controller . . . . . . . . . . . . . . . . . . . . . . . . . .1-1
1.3
Integrated Memory Controller . . . . . . . . . . . . . . . . . . . . . . . .1-2
1.4
PCI Bus Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .1-3
2
Overview
2-1
2.1
System . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .2-1
2.2
AMD-640 System Controller Buffers . . . . . . . . . . . . . . . . . . .2-4
2.3
Definitions, Conventions, and References . . . . . . . . . . . . . .2-5
2.3.1
2.3.2
Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-6
Related Publications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-7
3
Ordering Information
3-1
4
Signal Descriptions
4-1
4.1
Processor Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . .4-1
4.2
PCI Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4-5
4.3
DRAM Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4-8
4.4
Cache Controller Interface Signals . . . . . . . . . . . . . . . . . . .4-10
4.5
Clocks and Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4-12
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參數(shù)描述 |
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