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參數(shù)資料
| 型號： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 20/159頁 |
| 文件大?。?/td> | 1900K |
| 代理商： | AMD-640 |
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Overview
2-3
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
48-doubleword PCI-to-DRAM write buffer allows PCI initiators
to post writes to memory without adding delay on either the
PCI or processor bus. In addition, the AMD-640 system
controller contains a PCI arbiter.
Figure 2-1.
AMD-640 System Controller Block Diagram
D
C
Byte
Merge
Logic
5-doubleword
CPU-to-PCI
write buffer
16-doubleword
PCI buffer
P
I
P
I
C
C
HA[31:3]
HD[63:0]
ADS#
AHOLD
BE[7:0]#
BOFF#
BRDY#
CACHE#
D/C#
EADS#
HITM#
HLOCK#
KEN#/INV
M/IO#
NA#
SMIACT#
W/R#
AD[31:0]
C/BE[3:0]#
DEVSEL#
FRAME#
GNT[3:0]#
IRDY#
LOCK#
PAR
PGNT#
PREQ#
REQ[3:0]#
SERR#
STOP#
TRDY#
CAS[7:0]#/
DQM[7:0]#
MA[13:0]
MD[63:0]
MPD[7:0]
RAS[5:0]#/
CS[3:0]#
BWE#
CADS#
CADV#
CE1#
COE#
GWE#
TAGWE#
TA[9:0]
HCLK
PCLK
RESET#
10 doubleword
DRAM
read buffer
4-cache line
(32-doubleword)
DRAM
write buffer
2 doublewords
PCI read, cache hit,
or writeback forward
WE[C:A]#
SCAS[C:A]#
SRAS[C:A]#
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PDF描述 |
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