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參數(shù)資料
| 型號： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 146/159頁 |
| 文件大?。?/td> | 1900K |
| 代理商： | AMD-640 |
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Switching Characteristics
9-5
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
9.3
Processor Interface Timing
All of the following timings are relative to HCLK.
Pads 0 to 13 are driver types. For system simulation, select the
pad from the appropriate IBIS model.
Table 9-4.
Processor Cycle Timing
Symbol
Parameter Description
Preliminary Data
Min
Figure
Comments
Max
t
su
Setup time for
ADS#
HLOCK#
SMIACT#
HA[31:3]
W/R#
Setup time for
M/IO#
Setup time for
HD[63:0]
Hold time for
SMIACT#
W/R#
M/IO#
D/C#
ADS# hold time
DC#
CACHE#
BE[7:0]#
5 ns
9-2
t
su
5.5 ns
t
su
HITM#
6
9-2
t
su
3 ns
9-2
t
h
HITM#
CACHE#
BE[7:0]#
HA[31:3]
1 ns
9-2
t
h
t
h
t
h
1.5 ns
9-2
HLOCK# hold time
1.0 ns
9-2
HD[63:0] hold time
Valid delay for
AHOLD
KEN#/INV
BRDY#, NA# valid delay
HA[31:3] valid delay
HD[63:0] Valid delay
HA[31:3] float delay
2 ns
9-2
t
vd
BOFF#
EADS#
1.5 ns
7 ns
9-2
Pad 0 (note 1)
1.5 ns
2 ns
1.5 ns
4 ns
8 ns
13 ns
8.5 ns
9 ns
9-2
9-2
9-2
9-2
Pad 0 (note 1)
Pad 2 (note 1)
Pad 1 (note 1)
Note 1
t
fd
Notes:
1. Measurements are taken with no load.
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PDF描述 |
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