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參數(shù)資料
| 型號： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 126/159頁 |
| 文件大小： | 1900K |
| 代理商： | AMD-640 |
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Configuration Registers
7-29
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
Bit 7
Bank Decoding Test (RW)
0=Normal operation (default)
1=For production test only. DO NOT SET.
MA[1:0] Drive (RW)
0=12 mA (default)
1=24 mA
MA[1:0]/RAS[5:4]# (RW)
—This pin determines whether pins N17 and M17
function as RAS[5:4]# or secondary drivers for MA[1:0] as shown in Table
7-10.
Bit 6
Bit 5
Bit 4
Force SMM Mode (RW)
—When this bit is set the AMD-640 system controller
responds as if the SMIACT# pin was asserted.
0=SMM mode not forced (default)
1=SMM mode forced.
SDRAM command Drive (SRAS#, SCAS#, WEx#) (RW)
0=12 mA (default)
1=24 mA
MA[13:2] and WEx# Drive (RW)
0=12 mA (default)
1=24 mA
CAS# Drive (RW)
0=12 mA (default)
1=24 mA
RAS# Drive (RW)
0=12 mA (default)
1=24 mA
Bit 3
Bit 2
Bit 1
Bit 0
7.5.15
DRAM Drive Strength Control Register
(Offset 6Dh)
Bit 7
BDT
0
6
5
4
3
2
1
Bit 0
MA[1:0] Drive
0
MA/RAS#
0
FORCE SMM
0
SDRAMCD
0
MA&WED
0
CAS# Drive
0
RAS# Drive
0
Reset
Table 7-10.
Functions of Pins N17 and M17
Bit 5
Pin N17
Function
RAS5#
MA1
Pin M17
Function
RAS4#
MA0
Drive Control
0
1
Reg. 6Dh, bit 0
Reg. 6Dh, bit 6
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PDF描述 |
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參數(shù)描述 |
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