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參數(shù)資料
| 型號： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲器控制器，系統(tǒng)存儲器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 31/159頁 |
| 文件大?。?/td> | 1900K |
| 代理商： | AMD-640 |
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4-4
Signal Descriptions
AMD-640 System Controller Data Sheet
21090C/0—June 1997
Preliminary Information
memory or I/O space. When M/IO# is high, the AMD-640
System Controller enables accesses to DRAM and the L2
cache. When the access is not targeted to the cache or the
DRAM, the AMD-640 system controller uses M/IO# to generate
the PCI commands on C/BE[3:0] during the command phase of
CPU-to-PCI cycles.
NA#
Next Address
The AMD-640 system controller asserts NA# off the rising
HCLK edge to indicate to the host processor that it is ready to
accept a pipelined address.
Output
SMIACT#
System Management Interrupt Acknowledge
When SMIACT# from the host processor is sampled asserted, it
indicates to the AMD-640 system controller that the processor
has entered system management mode (SMM). If configuration
register 63h bit, 1 is set, asserted SMIACT# redirects memory
accesses from 30000h:3FFFFh to B0000h:BFFFFh. Accesses to
this memory area are passed through to the PCI bus when
SMIACT# is high, as this is normally the Video Buffer area.
Input
W/R#
Write/Read
The AMD-640 system controller samples W/R# to determine
whether the current processor cycle is a write or a read.
Input
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PDF描述 |
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