- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-640 (Advanced Micro Devices, Inc.) 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器)) PDF資料下載
參數(shù)資料
| 型號(hào)： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲(chǔ)器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 85/159頁 |
| 文件大?。?/td> | 1900K |
| 代理商： | AMD-640 |
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5-46
Functional Operation
AMD-640 System Controller Data Sheet
21090C/0—June 1997
Preliminary Information
PCI Bus Initiator
Write:
Cache Miss
Figure 5-28 shows a PCI write to DRAM. L1 and L2 are
snooped, and both miss. The AMD-640 system controller stores
the PCI data into its write buffer and subsequently writes this
data (A, B, C, D) to DRAM.
Figure 5-28. PCI Bus Initiator Write: Cache Miss
Addr
MWR
BE[3:0]#
A
B
C
D
Data Written to DRAM Write Buffer
Snoop L1 miss
Snoop L2 miss
Begin DRAM write
A,B
C,D
1
2
3
4
5
6
7
8
9
10
12
11
13
HCLK
W/R#
ADS#
EADS
#
BRDY#
HA31-HA3
BE[7:0]#
CADS#
COE#
HITM#
AHOLD
BOFF#
HD63-HD0
MD63-MD0
MA13-MA0
RAS[5:0]#
CAS[7:0]#
WEx#
PCLK
FRAME#
DEVSEL#
AD31-AD0
C/BE[3:0]#
IRDY#
TRDY#
REQ#
GNT#
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PDF描述 |
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參數(shù)描述 |
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