- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄366557 > AMD-640 (Advanced Micro Devices, Inc.) 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器)) PDF資料下載
參數(shù)資料
| 型號(hào)： | AMD-640 |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | 64-Bit Socket 7 Interface, Integrated Write back Cache Controller, System Memory Controller, and PCI Bus Controller.(64位系統(tǒng)控制器(包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和PCI總線控制器)) |
| 中文描述： | 64位Socket 7的接口，集成寫回高速緩沖存儲(chǔ)器控制器，系統(tǒng)內(nèi)存控制器和PCI總線控制器。（64位系統(tǒng)控制器（包括高速緩沖存儲(chǔ)器控制器，系統(tǒng)存儲(chǔ)器控制器和的PCI總線控制器）） |
| 文件頁數(shù)： | 28/159頁 |
| 文件大小： | 1900K |
| 代理商： | AMD-640 |
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Signal Descriptions
4-1
21090C/0—June 1997
AMD-640 System Controller Data Sheet
Preliminary Information
4
Signal Descriptions
4.1
Processor Interface Signals
ADS#
Address Strobe
ADS# indicates to the AMD-640 system controller that a new
bus cycle is starting. When ADS# is asserted, the AMD-640
system controller latches the address bus and all cycle
definition signals corresponding to this bus cycle on the rising
edge of HCLK.
Input
AHOLD
Address Hold
The AMD-640 system controller asserts AHOLD off the rising
edge of HCLK while a PCI initiator accesses main memory to
perform an inquire cycle. The host processor responds by
floating HA[31:3] to allow the AMD-640 system controller to
drive the address bus. See the timing diagrams in Section 6 for
example cycles.
Output
BE[7:0]#
Byte Enables
The AMD-640 system controller samples BE[7:0]# to determine
the valid data bytes during a write cycle and the requested
data bytes during a read cycle. The eight byte enable signals
correspond to the eight bytes of the data bus as follows:
Inputs
BOFF#
The AMD-640 system controller asserts BOFF# to acquire the
host bus during PCI-to-DRAM cycles in order to perform snoop
cycles and access the L1 and L2 caches in the event of a cache
hit. The processor unconditionally aborts any cycles in
Output
I
BE7#: D[63:56]
BE6#: D[55:48]
BE5#: D[47:40]
BE4#: D[39:32]
I
BE3#: D[31:24]
BE2#: D[23:16]
BE1#: D[15:8]
BE0#: D[7:0]
I
I
I
I
I
I
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PDF描述 |
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參數(shù)描述 |
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