參數(shù)資料
型號(hào)： HMS30C7202N
廠商： Electronic Theatre Controls, Inc.
英文描述： Highly-intergrated MPU
中文描述： 高intergrated微處理器
文件頁(yè)數(shù)： 87/179頁(yè)
文件大?。?/td> 2127K
代理商： HMS30C7202N
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 82 -
open page area clear this bit and set a reset command to SMCCMD.
Larger than 32MB SmartMedia support enable. When using 64MB or 128MB SmartMedia, set
this bit high.
0
R/W
9.3.2.6
SMC Timing Parameter Register (SMCTIME)
0x8001.6014
17
16
31
DMA SIZE
30
29
28
27
WAIT COUNTER
26
25
24
22
BYTE COUNTER
21
20
19
18
9
HIGH
COUNTER
8
2
1
0
LOW COUNTER
Bits
31:28
Type
R/W
Function
Multi-page DMA size bit. Maximum 15 pages are accessible at a time.
0000 = not defined.
0001 = 1 page
0010 = 2 pages
…
1111 = 15 pages
Wait counter maximum limit value. Waiting time delay between address latch and write data in
page program mode or between address latch and read data in read ID mode and read status
register is determined by this register.
0000 = 1 BCLK width
0001 = 2 BCLK width
…
1111 = 16 BCLK width
Reserved
Should set these bits as 0x7F to access full 512 bytes page at one access command (read or
program).
Reserved
High pulse width value of read enable and write enable signal. The width must satisfy the AC
characteristics of SmartMedia to guarantee correct transfer of data. With Safety Margin
enable, width will be decreased by one.
00 = 1 BCLK width (0 BCLK with safety margin enable. Don’t make this case)
01 = 2 BCLK width (1 BCLK with safety margin enable)
10 = 3 BCLK width (2 BCLK with safety margin enable)
11 = 4 BCLK width (3 BCLK with safety margin enable)
Reserved
Low pulse width value of read enable and write enable signal. The width must satisfy the AC
characteristics of SmartMedia to guarantee correct transfer of data. With Safety Margin
enable, width will be decreased by one.
000 = 1 BCLK width (0 BCLK with safety margin enable, Don’t make this case)
001 = 2 BCLK width (1 BCLK with safety margin enable)
…
111 = 8 BCLK width (7 BCLK with safety margin enable)
27:24
R/W
23
22:16
-
R/W
15:10
9:8
-
R/W
7:3
2:0
-
R/W
9.3.2.7
SMC Status Register (SMCSTAT)
0x8001.601C
24
SMR/B
16
31
CD INTR
23
CURRENT COMMAND/CARD DETECT NOTIFICATION
15
14
13
EXTRA
AREA
7
6
5
30
nSMCE
22
29
SMCLE
21
28
SMALE
20
27
nSMWE
19
26
nSMRE
18
25
nSMWP
17
12
11
10
9
8
BYTE COUNT
4
3
2
1
0
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