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參數資料
| 型號： | HMS30C7202N |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Highly-intergrated MPU |
| 中文描述： | 高intergrated微處理器 |
| 文件頁數： | 127/179頁 |
| 文件大?。?/td> | 2127K |
| 代理商： | HMS30C7202N |
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HMS30C7202N
2004 MagnaChip Semiconductor Ltd. All Rights Reserved. Version 1.1
- 122 -
Bits
7:0
Type
R/W
Function
Every timer in PS/2 controller is clocked by PRICLK except PRI COUNTER that generates
PRICLK itself. The reason why uses PRICLK instead of PCLK is that PCLK is too fast so
timing check counter requires more bits than slower clock rate. The period of PRICLK is
determined by (PSTPRI+1) * that of PCLK.
10.5.2.7
PSTXMT
0x8002.C018
7
PSTXMT
6
5
4
3
2
1
0
Bits
7:0
Type
R/W
Function
This parameter determines the maximum transmission time. It is calculated as t
PSTXMT
(D in
Figure 10-3
PS/2 Controller Transmitting Data Timing Diagram
) = (PSTXMT+1)*t
PSTPRI
(B in Figure 10-3
PS/2 Controller Transmitting Data Timing
Diagram
). Error condition is when t
(total transmission time, C in Figure 10-3
PS/2 Controller
Transmitting Data Timing Diagram
) exceeds t
PSTXMT
. Typical value of max. t
XMT
is 15ms. So adjust t
PSTPRI
and t
PSTXMT
to meet the
condition.
10.5.2.8
PSTREC
0x8002.C020
7
PSTREC
6
5
4
3
2
1
0
Bits
7:0
Type
R/W
Function
This parameter determines the maximum data receiving time. It is calculated as
t
PSTREC
(B in Figure 10-4 PS/2 Controller Receiving Data Timing Diagram
) = (PSTREC+1)*t
PSTPRI
(A in Figure 10-4 PS/2 Controller Receiving Data Timing
Diagram
). Error condition is when t
REC
(total receiving time, C in Figure 10-4 PS/2 Controller
Receiving Data Timing Diagram
) exceeds t
PSTREC
. Typical value of max. t
REC
is 15ms. So adjust t
PSTPRI
and t
PSTREC
to meet the condition.
A: t
, B: t
PSTREC
, C: t
REC
Figure 10-4 PS/2 Controller Receiving Data Timing Diagram
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